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龙图腾网恭喜中山大学申请的专利一种快速开启延时补偿电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115065259B 。

龙图腾网通过国家知识产权局官网在2025-06-17发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210684624.4，技术领域涉及：H02M7/12；该发明授权一种快速开启延时补偿电路是由郭建平;罗宇萱;陈宇棠设计研发完成，并于2022-06-17向国家知识产权局提交的专利申请。

本一种快速开启延时补偿电路在说明书摘要公布了：本发明申请公开了一种快速开启延时补偿电路，应用于串联‑串联谐振式无线能量传输系统的接收端电路中，通过开启延时补偿电路获取有源整流电路中第一比较器、第二比较器、第三比较器和第四比较器的输出信号，并通过第一逻辑电路和第二逻辑电路，基于数字逻辑控制生成第一补偿信号、第二补偿信号、第三补偿信号和第四补偿信号以补偿有源整流电路的开启延时，从而在有源整流电路一个工作周期内开启延时补偿，实现了开启延时补偿的快速开启；并且由于开启延时补偿仅依赖数字逻辑控制，提高了开启延时补偿的稳定性和抗PVT变化特性，进而提高了开启延时补偿的精度。本发明可广泛应用于集成电路领域。

本发明授权一种快速开启延时补偿电路在权利要求书中公布了：1.一种快速开启延时补偿电路，应用于串联-串联谐振式无线能量传输系统的接收端电路中，其特征在于，包括： 有源整流电路，包括第一比较器、第二比较器、第三比较器和第四比较器，所述第一比较器用于输出第一输出信号，所述第二比较器用于输出第二输出信号，所述第三比较器用于输出第三输出信号，所述第四比较器用于输出第四输出信号； 开启延时补偿电路，用于获取所述第一输出信号、所述第二输出信号、所述第三输出信号和所述第四输出信号，所述开启延时补偿电路包括第一逻辑电路和第二逻辑电路，所述第一逻辑电路用于基于数字逻辑控制根据所述第一输出信号和所述第二输出信号生成第一补偿信号和第二补偿信号，所述第二逻辑电路用于基于数字逻辑控制根据所述第三输出信号和所述第四输出信号生成第三补偿信号和第四补偿信号；或者，所述第一逻辑电路用于基于数字逻辑控制根据所述第一输出信号和所述第三输出信号生成所述第一补偿信号和所述第三补偿信号，所述第二逻辑电路用于基于数字逻辑控制根据所述第二输出信号和所述第四输出信号生成所述第二补偿信号和所述第四补偿信号，所述第一补偿信号、所述第二补偿信号、所述第三补偿信号和所述第四补偿信号用于补偿所述有源整流电路的开启延时； 所述有源整流电路还包括第一缓冲器、第二缓冲器、第三缓冲器、第四缓冲器、第一PMOS管、第二PMOS管、第一NMOS管、第二NMOS管、接地端、输出端和交流输入源，所述交流输入源为串联-串联谐振式无线能量传输系统的接收端电路输入所述有源整流电路的等效输入源； 所述第一比较器的输出端与所述开启延时补偿电路的第一输入端连接，所述开启延时补偿电路的第一输出端与所述第一缓冲器的输入端连接，所述第一缓冲器的输出端与所述第一PMOS管的栅极连接，所述第一PMOS管的源极与所述第一比较器的正相输入端连接，所述第一比较器的正相输入端与所述输出端连接，所述输出端与所述第二PMOS管的源极连接，所述第二PMOS管的源极与所述第二比较器的正相输入端连接，所述第二比较器的输出端与所述开启延时补偿电路的第二输入端连接，所述开启延时补偿电路的第二输出端与所述第二缓冲器的输入端连接，所述第二缓冲器的输出端与所述第二PMOS管的栅极连接，所述第二PMOS管的漏极与所述第二比较器的反相输入端连接，所述第二比较器的反相输入端与所述交流输入源的第二端连接，所述交流输入源的第二端与所述第二NMOS管的漏极连接，所述第二NMOS管的漏极与所述第四比较器的反相输入端连接，所述第四比较器的输出端与所述开启延时补偿电路的第四输入端连接，所述开启延时补偿电路的第四输出端与所述第四缓冲器的输入端连接，所述第四缓冲器的输出端与所述第二NMOS管的栅极连接，所述第二NMOS管的源极与所述第四比较器的正相输入端连接，所述第四比较器的正相输入端与所述接地端连接，所述接地端与所述第一NMOS管的源极连接，所述第一NMOS管的源极与所述第三比较器的正相输入端连接，所述第三比较器的输出端与所述开启延时补偿电路的第三输入端链接，所述开启延时补偿电路的第三输出端与所述第三缓冲器的输入端连接，所述第三缓冲器的输出端与所述第一NMOS管的栅极连接，所述第一NMOS管的漏极与所述第三比较器的反相输入端连接，所述第三比较器的反相输入端与所述交流输入源的第一端连接，所述交流输入源的第一端与所述第一PMOS管的漏极连接，所述第一PMOS管的漏极与所述第一比较器的反相输入端连接。

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