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龙图腾网获悉深圳市思远半导体有限公司申请的专利一种切换电路及方法、DCDC获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN117879566B 。

龙图腾网通过国家知识产权局官网在2025-06-27发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202410042496.2，技术领域涉及：H03K17/28；该发明授权一种切换电路及方法、DCDC是由伍滔设计研发完成，并于2023-10-08向国家知识产权局提交的专利申请。

本一种切换电路及方法、DCDC在说明书摘要公布了：本申请提供一种切换电路及方法、DCDC，该切换电路包括：依次连接的第一延时模块、第一计数模块和锁存模块。第一延时模块用于获取DCDC的开关管的周期信号，并根据周期信号和第一时间值，产生第一延时信号，第一计数模块计算第一延时信号连续产生的第一次数，并在第一次数大于或等于第一数值时输出第一计数信号至锁存模块，以使锁存模块输出第一指示信号，指示DCDC由正常模式切换至低功耗模式。该电路中通过连续计算开关周期大于第一时间值的次数大于第一数值时才进入低功耗模式，可降低出现负载瞬态由重载变为轻载而误进入低功耗模式的情况，提高DCDC进入低功耗模式的准确性。

本发明授权一种切换电路及方法、DCDC在权利要求书中公布了：1.一种切换电路，其特征在于，应用于DCDC，所述DCDC的开关管包括同步管和整流管，所述切换电路包括： 第一延时模块，用于获取所述同步管的控制信号、所述整流管的控制信号，并在所述整流管的控制信号与所述同步管的控制信号同时为低电平时从零开始计时，若计时达到第一时间值时，所述整流管的控制信号与所述同步管的控制信号仍然为低电平，产生第一延时信号； 第一计数模块，所述第一计数模块的输入端连接所述第一延时模块的输出端，所述第一计数模块用于计算所述第一延时信号连续产生的第一次数，并在所述第一次数大于或等于第一数值时输出第一计数信号； 锁存模块，所述锁存模块的第一输入端连接所述第一计数模块的输出端，所述锁存模块基于所述第一计数信号通过所述锁存模块的第一输出端输出第一指示信号，所述第一指示信号用于指示所述DCDC由正常模式切换至低功耗模式； 第二比较模块，所述第二比较模块的第一输入端连接所述DCDC的输出端，所述第二比较模块的第二输入端用于连接基准电压源；其中，所述第二比较模块基于所述DCDC的输出电压和所述基准电压源输出的基准电压，输出同步管的控制信号； 第二延时模块和第二计数模块，所述第二延时模块的第一输出端连接所述第二计数模块的输入端，所述第二计数模块的输出端连接所述锁存模块的第二输入端，所述第二延时模块用于根据所述同步管的控制信号和第二时间值，产生所述第二延时信号至所述第二计数模块，所述第二计数模块用于计算所述第二延时信号产生的第二次数，并在所述第二次数大于或等于第二数值时输出第二计数信号至所述锁存模块，所述锁存模块基于所述第二计数信号通过所述锁存模块的第一输出端输出第二指示信号，所述第二指示信号用于指示所述DCDC由低功耗模式切换至正常模式； 其中，所述第二延时模块包括第二延时单元和逻辑单元，所述第二延时单元包括上升沿延时子单元、第一下降沿延时子单元、非门和或非门，所述上升沿延时子单元的输入端和所述逻辑单元的第一输入端用于接收所述同步管的控制信号，所述上升沿延时子单元的输出端分别连接所述第一下降沿延时子单元的输入端和所述或非门的第一输入端，所述第一下降沿延时子单元的输出端连接所述非门的输入端，所述非门的输出端连接所述或非门的第二输入端，所述或非门的输出端连接所述逻辑单元的第二输入端，所述逻辑单元的第三输入端连接所述锁存模块的第三输出端，所述第二延时单元基于所述同步管的控制信号和所述第二时间值，产生第三延时信号至所述逻辑单元，所述逻辑单元用于根据所述同步管的控制信号、所述第三延时信号和所述锁存模块的第三输出端的输出信号，输出所述第二延时信号至所述第二计数模块，所述锁存模块的第三输出端的输出信号和所述锁存模块的第二输出端的输出信号电平相反。

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