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龙图腾网获悉上海爱信诺航芯电子科技有限公司申请的专利一种算法加速的硬件架构及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114327366B 。

龙图腾网通过国家知识产权局官网在2025-07-25发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202111548900.6，技术领域涉及：G06F7/544；该发明授权一种算法加速的硬件架构及方法是由刘红明;周玉洁;王大永设计研发完成，并于2021-12-17向国家知识产权局提交的专利申请。

本一种算法加速的硬件架构及方法在说明书摘要公布了：本发明公开了一种算法加速的硬件架构及方法，其硬件架构包括：寄存器阵列，用于存放控制参数、固定参数以及运算结果；控制器，用于控制运算器的运算法则，以及控制运算器读取寄存器阵列的值和存取器中的值；运算器，用于根据控制器给出运算法则进行相应的乘法、加法、减法及混合操作；存取器，用于存放运算的数据。这样，通过配置控制器和寄存器阵列，可以完成不同长度的乘累加，特征点间的距离以及求和运算等运算，加速指纹算法提取特征和匹配中各种算法；通过设置2块SRAM，在不增加整体芯片的面积下提升指纹算法的性能。该设计配置灵活，通用性强，占用面积小，可以对不同的指纹算法进行加速。

本发明授权一种算法加速的硬件架构及方法在权利要求书中公布了：1.一种算法加速的硬件系统，其特征在于，包括：寄存器阵列，用于存放控制参数、固定参数以及运算结果；控制器，用于控制运算器的运算法则，以及控制运算器读取寄存器阵列的值和存取器中的值；运算器，用于根据控制器给出运算法则进行相应的乘法、加法、减法及混合操作；存取器，用于存放运算的数据；所述寄存器阵列、控制器、运算器依次双向电性连接，所述存取器分别与所述控制器和运算器相连接； 所述寄存器阵列包括控制寄存器，所述控制寄存器第0位用来启动运算，第1位用来使能固定参数参与运算，第2位用来设置输入数据符号位，第3-6位共4位用来设置数组运算长度，第7-8位共2位用来设置数组1和2对应数据的运算法则，第9-10位共2位用来设置数组1和2对应数据运算后结果的运算法则,第11位设置数组第1个数据间结果和数组第2个数据间结果的运算法则,第12位设置数组第3个数据间结果和数组第4个数据间结果的运算法则,第13位设置数组第5个数据间结果和数组第6个数据间结果的运算法则,第14位设置数组第7个数据间结果和数组第8个数据间结果的运算法则。

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