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龙图腾网获悉中国科学院半导体研究所申请的专利阶数动态可重构折叠电路结构数字成形滤波器及设计方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115242220B 。

龙图腾网通过国家知识产权局官网在2025-08-05发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210882888.0，技术领域涉及：H03H17/06；该发明授权阶数动态可重构折叠电路结构数字成形滤波器及设计方法是由郭广浩;刘力源;刘剑;吴南健;徐萌萌设计研发完成，并于2022-07-26向国家知识产权局提交的专利申请。

本阶数动态可重构折叠电路结构数字成形滤波器及设计方法在说明书摘要公布了：本公开提供了一种阶数动态可重构折叠电路结构数字成形滤波器及设计方法。该数字成形滤波器包括：数据重定义逻辑单元，用于进行位宽变换；数据移位寄存器单元，用于对数据重定义逻辑单元的输出数据进行存储；第一加法器单元，用于根据折叠电路结构进行加法运算；冲击响应系数寄存器堆单元，用于写入冲击响应系数；重构完成标志寄存器单元，用于发出重构完成信号；乘法器单元，用于进行乘法运算并接收重构完成标志寄存器单元的输出信号；第二加法器单元，用于对乘法器单元的输出数据进行加法运算；阶数重构寄存器单元，用于写入数字成形滤波器的阶数；时序控制逻辑单元，用于选择结果数据；选择输出逻辑单元，用于输出结果数据。

本发明授权阶数动态可重构折叠电路结构数字成形滤波器及设计方法在权利要求书中公布了：1.一种阶数动态可重构折叠电路结构数字成形滤波器，包括： 数据重定义逻辑单元，用于对输入数据进行位宽变换； 数据移位寄存器单元，用于对所述数据重定义逻辑单元的输出数据进行存储，其中，所述数据移位寄存器单元包括多个数据移位寄存器，所述数据重定义逻辑单元的输出数据按照时序依次存入多个所述数据移位寄存器； 第一加法器单元，用于根据折叠电路结构对所述数据移位寄存器单元的输出数据进行加法运算； 冲击响应系数寄存器堆单元，用于写入数字成形滤波器的冲击响应系数； 重构完成标志寄存器单元，用于在阶数重构寄存器单元完成重构的情况下，发出重构完成信号； 乘法器单元，用于根据所述阶数对所述第一加法器单元的输出数据进行乘法运算并接收所述重构完成标志寄存器单元的输出信号； 第二加法器单元，用于在所述乘法器单元接收到所述重构完成信号的情况下，对所述乘法器单元的输出数据进行加法运算； 阶数重构寄存器单元，用于写入所述数字成形滤波器的阶数； 时序控制逻辑单元，用于根据所述阶数重构寄存器单元控制选择输出逻辑单元选择结果数据； 选择输出逻辑单元，用于根据所述时序控制逻辑单元的控制输出所述结果数据； 所述第一加法器单元，还用于在所述阶数为2i的情况下，根据所述折叠电路结构将多个所述数据移位寄存器中的第M个数据移位寄存器中存储的数据与第N个数据移位寄存器中存储的数据进行加法运算，其中，i为大于0的整数，，，M、N均为整数，且M+N=2i+1；以及 在所述阶数为2j-1的情况下，根据所述折叠电路结构将多个所述数据移位寄存器中第X个数据移位寄存器中存储的数据与第Y个数据移位寄存器中存储的数据进行加法运算，其中，j为大于0的整数，，，X、Y均为整数，且X+Y=2j。

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