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龙图腾网获悉华东师范大学申请的专利一种多输入多输出超高清视频处理与显示平台获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115643357B 。

龙图腾网通过国家知识产权局官网在2025-08-08发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211323978.2，技术领域涉及：H04N7/01；该发明授权一种多输入多输出超高清视频处理与显示平台是由刘玉华;刘一清;胡沂婷;曾文龙设计研发完成，并于2022-10-27向国家知识产权局提交的专利申请。

本一种多输入多输出超高清视频处理与显示平台在说明书摘要公布了：本发明公开了一种多输入多输出超高清视频处理与显示平台，它包括电源模块、时钟模块、视频输入模块、视频输出模块、视频解码模块、视频编码模块、视频处理模块、数据互联模块、视频缓存模块。本发明兼容多种分辨率视频通过HDMI接口输入和输出，单路最高支持4K@60Hz分辨率的视频输入和输出，同时本发明共有8路视频输入输出接口，可根据用户需求灵活设置视频输入和输出的路数。本发明搭载2片FPGA支持多种视频处理，具有处理延时低、配置灵活性高的特点，适用于超高清视频实时多路处理和显示。

本发明授权一种多输入多输出超高清视频处理与显示平台在权利要求书中公布了：1.一种多输入多输出超高清视频处理与显示平台，其特征在于，它包括电源模块（1）、时钟模块（2）、视频输入模块（3）、视频输出模块（4）、视频解码模块（5）、视频编码模块（6）、视频处理模块（7）、数据互联模块（8）、视频缓存模块（9）及系统控制模块（10）； 所述电源模块（1）与时钟模块（2）、视频输入模块（3）、视频输出模块（4）、视频解码模块（5）、视频编码模块（6）、视频处理模块（7）、数据互联模块（8）、视频缓存模块（9）及系统控制模块（10）连接，提供工作电源； 所述时钟模块（2）与视频输入模块（3）、视频输出模块（4）、视频解码模块（5）、视频编码模块（6）、视频处理模块（7）、数据互联模块（8）、视频缓存模块（9）及系统控制模块（10）连接，提供工作时钟； 所述视频输入模块（3）与视频解码模块（5）和系统控制模块（10）连接，用于控制解码操作与接收视频源的像素数据； 所述视频缓存模块（9）与视频解码模块（5）和视频处理模块（7）连接，用于存储接收的原视频数据和处理后的视频数据； 所述数据互联模块（8）与视频缓存模块（9）连接，用于传输、存储原视频数据或处理后的像素数据； 所述视频编码模块（6）与视频输出模块（4）、视频缓存模块（9）和系统控制模块（10）连接，用于控制编码操作和将存储的视频数据读出以及视频数据编码后进行显示；其中： 所述视频解码模块（5）包括解码像素时序调整模块（51）及视频解码芯片（52）；所述解码像素时序调整模块（51）将视频解码芯片（52）输出的像素数据根据视频的行场同步信号进行对齐，防止像素数据的错位；视频解码芯片（52）识别输入视频源的分辨率和将视频源数据根据预设格式解码出来； 所述的视频编码模块（6）包括编码像素时序调整模块（61）及视频编码芯片（62）；所述视频编码芯片（62）将FIFO输出缓存控制（92）输出的数据按照预设格式进行编码；编码像素时序调整模块（61）接收视频编码芯片（62）的像素数据后进行时序调整后送到视频输出模块（4），使其显示画面无误差； 所述的视频缓存模块（9）包括FIFO输入缓存控制（91）、FIFO输出缓存控制（92）、DDR3存储模块（93）及DDR4存储模块（94）；数据进行存储时通过FIFO输入缓存控制（91）进入到DDR3存储模块（93）或DDR4存储模块（94），数据进行读出的时候从DDR3缓存模块（93）或DDR4存储模块（94）读出，再经过FIFO输出缓存控制（92）进行速率匹配； 所述的系统控制模块（10）包括PS侧视频编解码芯片控制模块（101）及DDR4程序执行缓存模块（102）；其中PS侧视频编解码芯片控制模块（101）与视频编码芯片（62）、视频解码芯片（52）连接，控制编解码格式的选取与视频输入输出模式的选择；DDR4程序执行缓存模块（102）与PS侧视频编解码芯片控制模块（101）连接，为PS侧视频编解码芯片控制模块（101）提供高速的程序执行缓存。

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