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龙图腾网获悉电子科技大学申请的专利一种基于VPX标准的动态可重构多核心异构数字信号处理硬件系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115391250B 。

龙图腾网通过国家知识产权局官网在2025-08-08发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210819109.2，技术领域涉及：G06F13/38；该发明授权一种基于VPX标准的动态可重构多核心异构数字信号处理硬件系统是由彭礼彪;毕东杰;李西峰;李洪;谢永乐;帅萍;唐宇;谢暄设计研发完成，并于2022-07-12向国家知识产权局提交的专利申请。

本一种基于VPX标准的动态可重构多核心异构数字信号处理硬件系统在说明书摘要公布了：该发明公开了一种基于VPX标准的动态可重构多核心异构数字信号处理硬件系统，涉及高速高可靠数字信号处理系统设计领域。本发明实现异构并行信号运算及处理，外部数据可通过VPX连接器，以太网模块或光模块传输至FPGA处理器模块、DSP处理器模块进行运算，针对算力要求高的应用数据可使用DSP进行运算,针对具有算法硬件可编程的应用数据可使用FPGA进行运算，同时板到板连接模块可支持板载扩展。本发明硬件系统支持在线动态重构、远程加载、故障状态监控及故障自修复功能。

本发明授权一种基于VPX标准的动态可重构多核心异构数字信号处理硬件系统在权利要求书中公布了：1.一种基于VPX标准的动态可重构多核心异构数字信号处理硬件系统，该系统包括FPGA处理器模块、DSP处理器模块、VPX连接器、SRIO交换模块、以太网模块、光模块、电源管理模块、时钟管理模块、存储模块、BMC管理模块、CAN总线控制器、板到板连接模块；其中FPGA处理器模块包含3个FPGA：FPGA1、FPGA2、FPGA3；DSP处理器模块包含两个DSP：DSP1、DSP2；存储模块包含FLASH模块、DDR3模块；所述VPX连接器分别连接：FPGA1、以太网模块、FPGA2、FPGA3、CAN总线控制器；FPGA1、FPGA2、DSP1之间相互连接，FPGA1、FPGA2之间相互连接，FPGA1、FPGA2、DSP2之间相互连接，FPGA1、FPGA2、FPGA3、DSP1、DSP2都连接SRIO交换模块；DSP1、DSP2都与以太网模块连接，FPGA3还要单独连接以太网模块、CAN总线控制器、BMC管理模块、时钟管理模块、电源管理模块、DSP1、DSP2、FPGA1、FPGA2；所述DSP1、DSP2、FPGA3都设置有对应的FLASH模块、DDR3模块，FPGA1、FPGA2都设置有对应的FLASH模块、板到板连接器； 时钟管理模块为系统各模块提供时钟，并受FPGA3控制时钟分配； 电源管理模块受FPGA3控制电源开断； FPGA3以Selectmap接口、8对LVDS接口和9个LVCOMS接口与FPGA1、FPGA2相连； FPGA3通过GPIO接口与SPI接口与DSP1、DSP2相连； FPGA1、FPGA2接口相同，管脚分配一致；DSP1、DSP2接口相同，管脚分配一致。

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