飞腾信息技术有限公司;飞腾信息技术(深圳)有限公司黄薇获国家专利权
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龙图腾网获悉飞腾信息技术有限公司;飞腾信息技术(深圳)有限公司申请的专利一种逻辑代码质量检查方法、装置、服务器及存储介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120046554B 。
龙图腾网通过国家知识产权局官网在2025-08-12发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510422844.3，技术领域涉及：G06F30/3315；该发明授权一种逻辑代码质量检查方法、装置、服务器及存储介质是由黄薇设计研发完成，并于2025-04-07向国家知识产权局提交的专利申请。
本一种逻辑代码质量检查方法、装置、服务器及存储介质在说明书摘要公布了：本申请提供一种逻辑代码质量检查方法、装置、服务器及存储介质，应用于计算机技术领域，该方法在完成集成电路的逻辑综合后，提取集成电路中所有时序路径的起点寄存器和终点寄存器，统计每个寄存器的后级扇出寄存器数量以及前级扇入寄存器数量，并获取集成电路对应的寄存器数量阈值，若任一寄存器对应的前级扇入寄存器数量或后级扇出寄存器数量大于寄存器数量阈值，即确定集成电路的逻辑代码异常，相较于现有技术中在完成布局布线后再进行逻辑代码质量的检测，本申请提供的方法可在逻辑综合完成后即进行代码质量检测，能够尽早的完成逻辑代码的质量检测，有效避免在完成全部物理设计后才发现逻辑代码异常，提高设计效率。
本发明授权一种逻辑代码质量检查方法、装置、服务器及存储介质在权利要求书中公布了：1.一种逻辑代码质量检查方法，其特征在于，包括： 在完成集成电路的逻辑综合后，提取所述集成电路中所有时序路径的起点寄存器和终点寄存器； 统计每个寄存器的后级扇出寄存器数量以及前级扇入寄存器数量，所述后级扇出寄存器数量为该寄存器后级所连接的首个寄存器的总数，所述前级扇入寄存器数量为该寄存器前级所连接的首个寄存器的总数； 获取所述集成电路的设计参数，所述设计参数包括目标时钟频率、单级延时时长以及目标单级扇出值； 根据所述目标时钟频率、所述单级延时时长以及所述目标单级扇出值，确定所述集成电路对应的寄存器数量阈值； 若任一寄存器对应的前级扇入寄存器数量或后级扇出寄存器数量大于所述寄存器数量阈值，确定所述集成电路的逻辑代码异常。
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