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龙图腾网获悉上海奥令科电子科技有限公司申请的专利一种TIADC采样时间误差的数字校准电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN118353463B 。

龙图腾网通过国家知识产权局官网在2025-08-12发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202410498565.0，技术领域涉及：H03M1/10；该发明授权一种TIADC采样时间误差的数字校准电路是由王昕宇;唐杰设计研发完成，并于2024-04-24向国家知识产权局提交的专利申请。

本一种TIADC采样时间误差的数字校准电路在说明书摘要公布了：本发明提供的一种TIADC采样时间误差的数字校准电路，涉及模数转换器领域，该电路中TIADC模数转换器包括多路依次连接的时钟、采样开关和量化转换模块；时钟产生分频时钟；采样开关在对应的分频时钟的上升沿触发下导通，从而对输入数据进行采样，量化转换模块对采样数据进行量化，得到数字码值并发送给数字校准模块；数字校准模块对数字码值进行处理，得到每个采样开关的失配信息，根据失配信息，确定对应的待校准电路的补偿码值；时间误差补偿电路根据补偿码值对对应的时钟进行补偿，使每路时钟产生的分频时钟到对应的采样开关的时延相等。本发明实现了在全带宽区域内进行采样时间误差校准。

本发明授权一种TIADC采样时间误差的数字校准电路在权利要求书中公布了：1.种TIADC采样时间误差的数字校准电路，其特征在于，包括：TIADC模数转换器、数字校准模块和时间误差补偿电路；所述TIADC模数转换器包括多路量化电路；所述量化电路包括依次连接的时钟、采样开关和量化转换模块；其中，一路量化电路为基准电路；除基准电路之外的量化电路为待校准电路； 所述时钟用于产生分频时钟； 所述采样开关用于在对应的分频时钟的上升沿触发下导通，从而对输入数据进行采样，并将采样数据发送给对应的量化转换模块； 所述量化转换模块用于对接收到的采样数据进行量化，得到数字码值，并将所述数字码值发送给所述数字校准模块； 所述数字校准模块包括依次连接的多通道的采样误差提取与统计模块和流程控制与迭代模块； 所述多通道的采样误差提取与统计模块用于对所述待校准电路输出的所述数字码值进行处理，得到每个所述待校准电路的采样开关的失配信息； 所述多通道的采样误差提取与统计模块的失配信息计算公式为： ；或者； ； 其中，x[n]为当前n时刻的数字码值；；x[n-k1]为n-k1时刻的数字码值；x[n+k1]为n+k1时刻的数字码值；x[n-k2]为n-k2时刻的数字码值；x[n+k2]为n+k2时刻的数字码值；E为数学期望的统计平均；ΔE为采样开关的失配信息；，k1和k2为非零整数，k1=…、-2、-1、1、2、3...；k2=…、-2、-1、1、2、3...；其n=…、-2、-1、0、1、...，； 所述流程控制与迭代模块用于根据所述失配信息，确定对应的所述待校准电路的补偿码值； 所述流程控制与迭代模块的补偿码值计算公式为：； 其中，为第t轮迭代第j个待校准电路采样开关的失配信息；为第t轮迭代使用的补偿码值，为第t+1轮迭代使用的迭代补偿码值，为每次迭代的调节步进因子，sign是取数据的符号值； 所述时间误差补偿电路用于根据所述补偿码值对对应的时钟进行补偿，使每路所述时钟产生的分频时钟到对应的采样开关的时延相等。

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