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龙图腾网获悉山东云海国创云计算装备产业创新中心有限公司申请的专利提高FPGA原型验证效率的方法及装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114510894B 。

龙图腾网通过国家知识产权局官网在2025-08-12发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210108970.8，技术领域涉及：G06F30/343；该发明授权提高FPGA原型验证效率的方法及装置是由王奕;曲超;曹蓓设计研发完成，并于2022-01-28向国家知识产权局提交的专利申请。

本提高FPGA原型验证效率的方法及装置在说明书摘要公布了：本发明公开了一种提高FPGA原型验证效率的方法及装置，方法包括：运行设计综合命令以得出设计综合完成后的网表文件；运行report_qor_assessment命令获取当前的报告；检测报告分数并判断其分值与预设阈值的大小关系；若分值小于预设阈值，则检测设计并重复上述步骤；以及若分值大于等于预设阈值，则继续进行时钟关系判断、时序结果判断、组合逻辑链级数阈值判断、扇出阈值判断以生成新的综合策略和实现策略。该方法在FPGA原型验证实现流程中，设计综合后就可以分别对扇出、逻辑级数、时钟关系和时序结果等进行自动化分析报告与设定参数比较并生成有效的实现策略，可以提高FPGA原型验证实现的正确性，提高原型验证的效率。

本发明授权提高FPGA原型验证效率的方法及装置在权利要求书中公布了：1.一种提高FPGA原型验证效率的方法，其特征在于，包括： 运行设计综合命令以得出设计综合完成后的网表文件，其包括：完成HDL代码到硬件电路的转化和映射，并生成实现需要的网表文件； 运行report_qor_assessment命令获取当前的报告； 检测报告分数并判断其分值与预设阈值的大小关系； 若分值小于预设阈值，则检测设计并重复上述步骤；以及 若分值大于等于预设阈值，则继续进行时钟关系判断、时序结果判断、组合逻辑链级数阈值判断、扇出阈值判断以生成新的综合策略和实现策略； 其中，所述时钟关系判断包括：判断是否存在不期望的同步时钟路径；若存在，则添加异步时序约束文件解决；以及若不存在，则继续进行时序结果判断； 所述时序结果判断包括：判断时序结果是否收敛；若不收敛，则建立保持时间违例处理；若收敛，则进行组合逻辑链级数阈值判断； 所述组合逻辑链级数阈值判断包括：判断组合逻辑链级数的阈值范围；若超出阈值范围，则重新进行时序约束；若未超出阈值范围，则修改时序约束或者将综合策略修改为retiming00c综合； 所述扇出阈值判断包括：判断扇出阈值；若超出扇出阈值，则在实现阶段选择相应的优化策略；若未超出扇出阈值，则生成新的综合策略和实现策略；所述在实现阶段选择相应的优化策略包括：在实现阶段采取以下两种方式处理opt_designmerge_equivalent_drivershier_fanout_limit512；或phys_opt_design-force_replication_on_nets[get_netsnet_name]。

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