北京嘉楠捷思信息技术有限公司刘杰尧获国家专利权
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龙图腾网获悉北京嘉楠捷思信息技术有限公司申请的专利多路并联寄存器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN110633104B 。
龙图腾网通过国家知识产权局官网在2025-08-12发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：201810667038.2，技术领域涉及：G06F9/30；该发明授权多路并联寄存器是由刘杰尧;张楠赓;吴敬杰;马晟厚设计研发完成，并于2018-06-25向国家知识产权局提交的专利申请。
本多路并联寄存器在说明书摘要公布了：本发明提供一种在计算设备中应用的多路并联寄存器，包括多个输入端，用于输入数据；一时钟控制端，用于输入时钟信号；多个输出端，用于输出数据；多个动态D触发器，所述多个动态D触发器并联连接，用于在时钟信号控制下锁存和或读出所述数据；一时钟缓冲器，用于将所述时钟控制端输入的时钟信号缓冲之后向所述多个动态D触发器提供时钟信号。可以简化后端布局布线流程，降低设计难度，提高性能，增加实用性。
本发明授权多路并联寄存器在权利要求书中公布了：1.一种多路并联寄存器，其特征在于，包括： 多个输入端，用于输入数据； 一时钟控制端，用于输入时钟信号； 多个输出端，用于输出数据； 一时钟缓冲器，用于将所述时钟控制端输入的时钟信号缓冲之后向多个动态D触发器提供时钟信号； 多个动态D触发器，所述多个动态D触发器并联连接在所述多个输入端和所述多个输出端之间，用于在时钟信号控制下锁存和或读出所述数据，每一所述多个动态D触发器包括一第一锁存单元，一第二锁存单元以及一输出驱动单元； 其中，所述第二锁存单元在所述时钟信号控制下通过单一器件实现高电平、低电平和高阻三种状态的输出。
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1、本报告根据公开、合法渠道获得相关数据和信息，力求客观、公正，但并不保证数据的最终完整性和准确性。
2、报告中的分析和结论仅反映本公司于发布本报告当日的职业理解，仅供参考使用，不能作为本公司承担任何法律责任的依据或者凭证。
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