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龙图腾网获悉杭州来克莎科技有限公司申请的专利基于FPGA的线速比特掩码报文匹配方法及装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120238494B 。

龙图腾网通过国家知识产权局官网在2025-08-15发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510518991.0，技术领域涉及：H04L45/745；该发明授权基于FPGA的线速比特掩码报文匹配方法及装置是由李晨雨;郝贵松;金梦怡;徐军权设计研发完成，并于2025-04-23向国家知识产权局提交的专利申请。

本基于FPGA的线速比特掩码报文匹配方法及装置在说明书摘要公布了：本申请公开了一种基于FPGA的线速比特掩码报文匹配方法，FPGA包括至少一个块RAM，块RAM包括多个存储地址，包括：获取N个匹配规则，每个匹配规则包括规则号、关键字和掩码；根据N个匹配规则在块RAM中执行匹配规则的配置：针对每一个匹配规则，根据匹配规则中掩码的有效位以及对应的关键字，确定匹配规则所对应的至少一个存储地址，以匹配规则的规则号确定存储地址的N个比特位中要配置的比特位，在该比特位中写入生效比特值；以接收报文中的五元组信息作为块RAM的存储地址，读取存储地址对应的多个生效比特值，基于各个生效比特值确定报文命中的各个匹配规则的规则号。本申请能够线速实现报文的比特掩码规则匹配。

本发明授权基于FPGA的线速比特掩码报文匹配方法及装置在权利要求书中公布了：1.一种基于FPGA的线速比特掩码报文匹配方法，其特征在于，所述FPGA包括至少一个块RAM，所述块RAM包括多个存储地址，所述存储地址所对应的存储空间具有N个比特位，所述方法包括： 获取预设的N个匹配规则，每个匹配规则包括规则号、关键字和所述关键字对应的掩码，所述规则号为0~N-1，N为自然数； 根据所述N个匹配规则在所述块RAM中执行匹配规则的配置，所述匹配规则的配置的步骤包括：针对每一个匹配规则，根据所述匹配规则中掩码的有效位以及对应的关键字，确定所述匹配规则所对应的至少一个存储地址，以所述匹配规则的规则号确定存储地址的N个比特位中所要配置的比特位，在所要配置的比特位中写入用以表征匹配规则生效的生效比特值； 对接收报文进行解析生成五元组信息，以所述五元组信息作为所述块RAM的存储地址，读取所述存储地址所对应的多个生效比特值，基于各个生效比特值所对应的各个比特位，确定接收报文命中的各个匹配规则的规则号； 其中，根据所述匹配规则中掩码的有效位以及对应的关键字，确定所述匹配规则所对应的至少一个存储地址，包括： 获取所述匹配规则中的关键字和所对应的掩码，确定所述掩码中的多个有效位，其中，所述掩码中各个比特位的取值表征所述关键字中相同比特位是否有效，所述有效位为掩码值为1的比特位，非有效位为掩码值为0的比特位； 在所述关键字的各个比特位中，将与各个非有效位的比特位置相同的各个比特位用待定值表示，将与各个有效位的比特位置相同的各个比特位的值保持不变，所述待定值的取值为0或1； 以各个比特位的所述待定值的取值不同和保持不变的比特位的比特值，确定不同的比特取值组合，以所述不同的比特取值组合表示所述匹配规则对应的所述块RAM的多个存储地址。

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