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龙图腾网获悉中国科学院长春光学精密机械与物理研究所申请的专利基于联合相位调整的多通道数据训练方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115987453B 。

龙图腾网通过国家知识产权局官网在2025-08-19发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211641307.0，技术领域涉及：H04L1/00；该发明授权基于联合相位调整的多通道数据训练方法是由李强;李国宁;齐彪;吕增明;张宇;金龙旭设计研发完成，并于2022-12-20向国家知识产权局提交的专利申请。

本基于联合相位调整的多通道数据训练方法在说明书摘要公布了：本发明涉及一种基于联合相位调整的多通道数据训练方法，在该方法中，接收器实时采样发送端发送的固定码型训练字，FPAG控制逻辑通过调节IODLEAY数据延迟单元对输入数据进行延迟控制，并完成多通道延迟对齐；FPAG控制逻辑通过控制时钟管理单元DCM单元调节采样时钟相位；FPAG控制逻辑控制接收器锁存位置，直到锁存住与发送端发送的训练字相同的数据位置，至此完成数据训练。本发明利用FPGA内部的时钟管理单元DCM及IODELAY数据延迟单元实现采样时钟与数据输入延迟的联合相位调整，有效提高高速数据通信的训练可靠性，确保高速数据能够可靠的被接收器采集，降低误码率，且适用范围更广。

本发明授权基于联合相位调整的多通道数据训练方法在权利要求书中公布了：1.一种基于联合相位调整的多通道数据训练方法，其特征在于，发送端发送的多通道输入数据输入至IODELAY数据延迟单元，IODELAY数据延迟单元输出的延迟数据输入到接收器；时钟输入信号经过时钟管理单元DCM后作为接收器的采样时钟输出至接收器，所述时钟输入信号来自发送端或者来自接收端本地时钟，以适用于同步数据接收或者异步数据接收；FPGA控制逻辑对IODELAY数据延迟单元进行数据延迟控制的同时，还用于控制时钟管理单元DCM单元，实现对采样时钟的相位调整； 所述多通道数据训练方法通过以下步骤实现： 步骤一：接收器实时采样发送端发送的固定码型训练字，FPAG控制逻辑通过调节IODLEAY数据延迟单元对输入数据进行延迟控制，并且每进行一步延迟调整，接收器进行多次连续采集，若连续采集结果相同，则判定为稳定区间，若连续采集结果不同，则判定为不稳定区；当各通道均处于采样不稳定区间时，完成多通道延迟对齐； 步骤二：FPAG控制逻辑通过控制时钟管理单元DCM单元调节采样时钟相位，具体调节过程如下： 遍寻时钟管理单元DCM控制相位的整个区间，同时记录下各通道均为稳定区的时钟相位位置以及各通道均为稳定区的时钟相位跨度； 遍寻结束后，选取各通道均为稳定区的最大时钟相位跨度Pspan以及所对应的时钟相位起始位置Pstart，调节采样时钟相位至Pstart+Pspan2,调节后的采样时钟相位为最终采样时钟相位，完成位训练； 步骤三：FPAG控制逻辑控制接收器锁存位置，直到锁存住与发送端发送的训练字相同的数据位置，至此完成数据训练。

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