重庆港宇高科技开发有限公司唐逍熠获国家专利权
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龙图腾网获悉重庆港宇高科技开发有限公司申请的专利一种基于FPGA实现SLVS-EC串行解码方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115695824B 。
龙图腾网通过国家知识产权局官网在2025-09-05发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211126105.2，技术领域涉及：H04N19/44；该发明授权一种基于FPGA实现SLVS-EC串行解码方法是由唐逍熠;刘宇;谭长兴设计研发完成，并于2022-09-16向国家知识产权局提交的专利申请。
本一种基于FPGA实现SLVS-EC串行解码方法在说明书摘要公布了：本发明公开一种基于FPGA实现SLVS‑EC串行解码方法，将N通道SLVS‑EC高速串行数据，通过FPGA的硬核GT完成接收，得到N通道并行数据；将数据位宽由转换为一半，输出仍为N通道并行数据；检测数据中的控制码，并标识有效数据；去除数据中的Pad编码，并同时完成通道对齐功能；去除数据中的ECC纠错码；将字节转换为像素，数据位宽变小；进行包头解析，获得包头信息；根据包头信息获取时序参数；基于时序参数利用时序发生器，产生XSVI时序；进行数据缓存，将数据与XSVI时序进行匹配，并转换为N2通道并行数据。本发明能够解决现有解码方式无法完成SLVS‑EC编码解码的问题。
本发明授权一种基于FPGA实现SLVS-EC串行解码方法在权利要求书中公布了：1.一种基于FPGA实现SLVS-EC串行解码方法，其特征在于，包括步骤： S10,将N通道SLVS-EC高速串行数据，通过FPGA的硬核GT完成接收，得到N通道并行数据； S20,将数据位宽转换为一半，输出仍为N通道并行数据； S30,检测数据中的控制码，并标识有效数据； S40,去除数据中的Pad编码，并同时完成通道对齐功能； S50,去除数据中的ECC纠错码； S60,将字节转换为像素，数据位宽变小； S70,进行包头解析，获得包头信息； S80,根据包头信息获取时序参数； S80,基于时序参数利用时序发生器，产生XSVI时序； S90,进行数据缓存，将S60得到的数据与XSVI时序进行匹配，并转换为N2通道并行数据。
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2、报告中的分析和结论仅反映本公司于发布本报告当日的职业理解，仅供参考使用，不能作为本公司承担任何法律责任的依据或者凭证。
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