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龙图腾网获悉成都中科微信息技术研究院有限公司申请的专利一种基于高速DAC和FPGA的大带宽线性调频信号产生方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115166709B 。

龙图腾网通过国家知识产权局官网在2025-09-05发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210902356.9，技术领域涉及：G01S13/26；该发明授权一种基于高速DAC和FPGA的大带宽线性调频信号产生方法是由韩丰林;孙培林;汤小为;龚宁;马晓瑛;代霞设计研发完成，并于2022-07-29向国家知识产权局提交的专利申请。

本一种基于高速DAC和FPGA的大带宽线性调频信号产生方法在说明书摘要公布了：本发明提供一种基于高速DAC和FPGA的大带宽线性调频信号产生方法，包括：通过高速DAC的参数确定DDSIP核的参数；通过LFM信号的带宽B和持续时间τ计算相位控制字k0和Δk；将k0和Δk输入FPGA，FPGA根据k0和Δk计算相位偏置koffm、初始相位增量kincm,0、相位增量的变化量dkinc，再根据dkinc计算输入相位控制字增量kincm,i；配置M个DDSIP核，将koffm和kincm,i送入M个DDSIP核，输出M路复信号；配置高速DAC，将M路复信号送至高速DAC完成上变频，高速DAC输出大带宽LFM信号。本发明在满足信号带宽小于或等于DAC采样带宽的条件下可以产生任意调频斜率的宽带LFM信号，灵活性高，由精度带来的带宽积累误差小。

本发明授权一种基于高速DAC和FPGA的大带宽线性调频信号产生方法在权利要求书中公布了：1.一种基于高速DAC和FPGA的大带宽线性调频信号产生方法，其特征在于，包括以下步骤： 步骤1、通过高速DAC的半采样率和通道数M计算确定DDSIP核处理时钟速率，确定DDSIP核的相位控制字量化位数，并根据高速DAC工作数据位宽确定DDSIP核输出数据位宽； 步骤2、通过LFM信号的带宽和持续时间预先计算好起始频率所对应的DDS相位控制字，以及频率增量所对应的DDS相位控制字； 步骤3、将相位控制字和作为FPGA的输入信号，FPGA根据相位控制字和计算每一路DDSIP核的相位偏置和初始相位增量； 步骤4、FPGA根据相位控制字和计算出每一路DDSIP核的相位增量的变化量，再根据相位增量的变化量进行迭代计算每一路DDSIP核在时刻i的输入相位控制字增量； 步骤5、配置M个DDSIP核，将相位偏置和相位控制字增量分别送入M个DDSIP核，输出M路复信号；步骤5具体为：配置DDSIP核工作模式为PhaseGeneratorandSINCOSLUT，相位控制字位宽为q，工作时钟为，配置DDSIP核输出数据位宽与高速DAC工作数据位宽一致，将第m路DDSIP核的相位偏置接至DDSIP核的CHAN_0_POFF接口，将第m路DDSIP核在时刻i的输入相位控制字增量接至DDSIP核的CHAN_0_PINC接口，DDSIP核输出M路复信号； 步骤6、配置高速DAC，将M路复信号送至高速DAC完成上变频，高速DAC输出大带宽LFM信号； 步骤2包括如下子步骤： 步骤2-1、LFM信号的表达式为： 其中，为起始频率；，表示信号的调频斜率；为时间； 步骤2-2、LFM信号的相位表达式为： 步骤2-3、将时间t离散化后得到相位表达式： ， 其中，为复信号的采样周期；，表示LFM信号持续时间内的采样点数； 步骤2-4、令，表示每个采样点的频率步进，则相位表达式进一步表示为： 步骤2-5、将LFM信号的相位对进行位量化，量化后的相位表示为： 步骤2-6、对步骤2-5的相位分M路抽取，则第m路的相位表示为： 其中，，表示第m路的第i个时刻点； 令，表示每路DDSIP核中起始频率所对应的DDS相位控制字； 令，表示每路DDSIP核中频率增量所对应的DDS相位控制字； 基于相位控制字和的第m路DDSIP核的相位表示为： ； 步骤3中第m路DDSIP核的相位偏置表示为： ； 步骤3中第m路DDSIP核的初始相位增量表示为： ； 步骤4中第m路DDSIP核的相位增量的变化量表示为： ； 步骤4中第m路DDSIP核在时刻i的输入相位控制字增量表示为： 。

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