富士施乐株式会社塩安麻人获国家专利权
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龙图腾网获悉富士施乐株式会社申请的专利多处理器系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN111723043B 。
龙图腾网通过国家知识产权局官网在2025-09-05发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：201910832331.4，技术领域涉及：G06F15/173；该发明授权多处理器系统是由塩安麻人;池田真歩;谷畑友树;野田尚志;野村建太设计研发完成，并于2019-09-04向国家知识产权局提交的专利申请。
本多处理器系统在说明书摘要公布了：一种多处理器系统，其至少包括第1处理器和第2处理器，所述多处理器系统具备：存储单元，存储第1处理器执行的第1程序和第2处理器执行的第2程序；存储器部，具有所述第2处理器的存储器使用区域；及监视单元，经由通信线路而连接于所述存储单元及所述存储器部，在从所述存储单元读取的程序为所述第2程序的情况下，将所读取的所述第2程序存储于所述存储器部。所述多处理器系统能够比现有技术更快地启动第2处理器。
本发明授权多处理器系统在权利要求书中公布了：1.一种多处理器系统，其至少包括第1处理器和第2处理器， 所述多处理器系统具备： 存储单元，连接于所述第1处理器但不直接连接于所述第2处理器，存储所述第1处理器执行的第1程序和所述第2处理器执行的第2程序； 存储器部，不直接连接于所述第1处理器但直接连接于所述第2处理器，具有所述第2处理器的存储器使用区域； 监视单元，经由连接所述第1处理器和所述第2处理器之间的通信线路而连接于所述存储单元及所述存储器部，在从所述存储单元读取的程序为所述第2程序的情况下，将所读取的所述第2程序存储于所述存储器部；及 处理器间接口，连接所述第1处理器和所述第2处理器，构成为和所述通信线路不同的路径， 所述第1处理器将所述处理器间接口进行初始化， 所述监视单元在和所述第1处理器进行所述处理器间接口的初始化相同的时刻，开始从所述存储单元读取的所述第2程序向所述存储器部的存储， 在所述处理器间接口的初始化中，将所述第2程序经由所述通信线路向所述存储器部存储。
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