同济大学车思亮获国家专利权
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龙图腾网获悉同济大学申请的专利一种实现低谐波数据加权平均算法的电路模块及Delta-Sigma调制器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114826275B 。
龙图腾网通过国家知识产权局官网在2025-09-09发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210394784.5，技术领域涉及：H03M3/00；该发明授权一种实现低谐波数据加权平均算法的电路模块及Delta-Sigma调制器是由车思亮;邱雷设计研发完成，并于2022-04-15向国家知识产权局提交的专利申请。
本一种实现低谐波数据加权平均算法的电路模块及Delta-Sigma调制器在说明书摘要公布了：本发明公开了一种实现低谐波数据加权平均算法的电路模块及Delta‑Sigma调制器，该电路模块包括：温度计译码器，用于将输入的3位二进制码转化成8位温度计码；周期性随机信号发生器，用于每隔M个时钟产生一个随机信号；三输入模加法器，用于将当前时钟的输入二进制码、周期性随机信号发生器的输出及上一时钟的地址指针相加后对8求余，生成新的地址指针，以控制桶型移位寄存器的移位操作；D触发器；桶型移位寄存器，用于根据当前时钟的地址指针ptr[2:0]对输入的温度计码进行相应的移位操作，并将移位后的数据输出给1‑bitDAC单元。本发明结构简单，并且能够在不明显增加噪底的前提下有效抑制传统数据加权平均电路模块的输出谐波，提高了系统的线性度。
本发明授权一种实现低谐波数据加权平均算法的电路模块及Delta-Sigma调制器在权利要求书中公布了：1.一种实现低谐波数据加权平均算法的电路模块，其特征在于，该电路模块包括： 温度计译码器，用于将输入的3位二进制码转化成8位温度计码； 周期性随机信号发生器，所述周期性随机信号发生器周期为M，用于每隔M个时钟产生一个随机信号； 三输入模加法器，用于将当前时钟的输入二进制码、所述周期性随机信号发生器的输出及上一时钟的地址指针相加后对8求余，生成新的地址指针，以控制桶型移位寄存器的移位操作； D触发器，所述D触发器的输入端接所述三输入模加法器的输出端，并且输出端接至所述三输入模加法器的其中一个输入端和所述桶型移位寄存器； 桶型移位寄存器，用于根据当前时钟的地址指针ptr[2:0]对输入的温度计码进行相应的移位操作，并将移位后的数据输出给1-bitDAC单元。
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2、报告中的分析和结论仅反映本公司于发布本报告当日的职业理解，仅供参考使用，不能作为本公司承担任何法律责任的依据或者凭证。
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