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龙图腾网获悉合肥大唐存储科技有限公司申请的专利一种串行外设接口的主机接收器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119336666B 。

龙图腾网通过国家知识产权局官网在2025-09-23发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411392408.8，技术领域涉及：G06F13/12；该发明授权一种串行外设接口的主机接收器是由马成志;张磊;卓越;张宾;章涛;王传杰设计研发完成，并于2024-09-30向国家知识产权局提交的专利申请。

本一种串行外设接口的主机接收器在说明书摘要公布了：一种串行外设接口的主机接收器，本公开实施例适用于包含串行外设接口SPI主机接收器的应用场景，通过时钟域的分割，提升了串行采样信号SCK时延的精度，在数据传输开始前，通过走线延迟探测模块检测SPI从机片选信号发出和返回的时间差来自动调整采集主输入从输出MISO数据的时间，提升了对MISO的采样准确度，提高了SPI主机接收器接收SPI从机返回数据的准确率。

本发明授权一种串行外设接口的主机接收器在权利要求书中公布了：1.一种串行外设接口的主机接收器，其特征在于，包括：快时钟域单元和慢时钟域单元；其中， 快时钟域单元包括走线延迟探测模块和时钟延迟模块；其中， 走线延迟探测模块设置为：探测不同条件下串行外设接口SPI从机的片选信号CSN芯片内的走线延迟； 时钟延迟模块设置为：将走线延迟探测模块探测的CSN芯片内的走线延迟和确定的CSN芯片外延时相加，计算出SPI信号的总延迟时间；将串行采样信号SCK延迟计算出的SPI信号的总延迟时间后得到延迟处理后的SCK，并将延迟处理后的SCK发送给异步先入先出FIFO模块；通过接收返回的SCK信号计算SCK芯片内的走线延迟，并发送给寄存器配置模块； 慢时钟域单元包括：寄存器配置模块、信号产生模块、循环冗余校验CRC校验模块和异步FIFO模块；其中， 寄存器配置模块设置为：根据CRC校验结果确定的SPI信号CSN芯片外的时间延迟，将确定的CSN芯片外的时间延迟发送至时钟延迟模块；通过比对时钟延迟模块计算的SCK芯片内的走线延迟与走线延迟探测模块计算的CSN芯片内走线延迟，修正SCK和CSN之间的建立和保持时间，以保证SPI的正常工作； 信号产生模块设置为：产生SPI主机接收器与SPI从机通信所需的CSN和SCK信号； CRC校验模块设置为：在CRC校验使能开启后进行CRC校验后，将CRC校验结果反馈给寄存器配置模块； 异步FIFO模块设置为：配置FIFO写时钟为延迟处理后的SCK信号；控制写使能保持打开状态，控制读使能在FIFO非空的情况下打开； 其中，所述快时钟域单元的快时钟频率是所述慢时钟域单元的慢时钟频率的4倍及以上。

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