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龙图腾网获悉中国电子科技集团公司第五十八研究所申请的专利一种基于互连线串扰计算的抗辐照D触发器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120567108B 。

龙图腾网通过国家知识产权局官网在2025-10-03发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511057710.2，技术领域涉及：H03K3/037；该发明授权一种基于互连线串扰计算的抗辐照D触发器是由段鑫沛;李松原;陈加伟;殷亚楠;周昕杰设计研发完成，并于2025-07-30向国家知识产权局提交的专利申请。

本一种基于互连线串扰计算的抗辐照D触发器在说明书摘要公布了：本发明涉及一种基于互连线串扰计算的抗辐照D触发器，包括主级锁存模块和从级锁存模块的级联结构；主级锁存模块通过第一互连线串扰电路CC1将输入信号转换为双节点冗余信号，利用L1‑L3、L2‑L3容性耦合实现仅双高输入触发高输出的逻辑存储；从级锁存模块通过第二互连线串扰电路生成冗余信号L4L5，结合MullerC单元对CC2输出和直传信号进行纠错。本发明D触发器仅需16个最小尺寸晶体管，晶体管数量较传统TMR降低67%；支持异步复位，复位时强制L3L6充电至高电平；通过金属层走线控制容性耦合强度，显著提升航天电子系统在辐射环境下的可靠性。

本发明授权一种基于互连线串扰计算的抗辐照D触发器在权利要求书中公布了：1.一种基于互连线串扰计算的抗辐照D触发器，其特征在于，包括主级锁存模块和从级锁存模块的级联结构； 所述主级锁存模块包括：输入信号端口依次连接第一反相器、第一传输门，所述第一传输门由PMOS管MP2与NMOS管MN1构成，MP2栅极接正向时钟，MN1栅极接反向时钟； 所述第一传输门输出端分两路分别驱动第一互连线串扰计算电路的互连线L1和L2，L3输出端经第二反相器生成主级输出信号； 异步复位端口通过PMOS管MP1连接L3，当Reset为低电平时强制L3充电至高电平； 所述主级锁存模块的核心为第一互连线串扰计算电路，通过互连线L1、L2与L3间的容性耦合机制，在正向时钟有效时将输入信号转换为双节点冗余信号并存储于互连线，仅当L1与L2同时为高电平时触发L3输出高电平，经第二反相器生成主级输出信号； 所述从级锁存模块包括：主级输出信号依次连接第三反相器、第二传输门，所述第二传输门由PMOS管MP4与NMOS管MN2构成，MP4栅极接反向时钟，MN2栅极接正向时钟； 所述第二传输门输出端分三路：第一路驱动L4，第二路驱动L5，第三路直连Muller C单元的第一输入端C1；异步复位端口通过PMOS管MP3连接L6，第二互连线串扰计算电路的L6输出端连接Muller C单元的第二输入端C2； 所述从级锁存模块的核心为第二互连线串扰计算电路与Muller C单元的组合结构，通过互连线L4、L5与L6的容性耦合机制，在反向时钟有效时将主级输出信号转换为双节点冗余信号并存储，仅当L4与L5同时为高电平时触发L6输出高电平，结合Muller C单元对CC2输出端和直接传输信号的纠错机制，生成抗辐照输出信号； 其中，设有的双节点冗余存储与Muller C单元纠错机制协同作用，通过物理隔离的互连线结构分散辐射敏感节点，抑制单粒子翻转传播。

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