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龙图腾网获悉上海大学申请的专利一种非相关扩频伪码同步的FPGA实现方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115765786B 。

龙图腾网通过国家知识产权局官网在2025-10-17发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211114601.6，技术领域涉及：H04B1/7073；该发明授权一种非相关扩频伪码同步的FPGA实现方法是由张俊杰;冯智波;李迎春;陈健;宋英雄;张倩武;曹炳尧设计研发完成，并于2022-09-14向国家知识产权局提交的专利申请。

本一种非相关扩频伪码同步的FPGA实现方法在说明书摘要公布了：本发明公开了一种非相关扩频伪码同步的FPGA实现方法，包括以下步骤：获取参数，根据参数计算参与相关运算的数据的采样点的采样位置；计算小段数目K的小段本地伪码与采样点数据的相关运算值，将K小段的相关值平方后累加，得到最终的相关值；将采样数据按照采样速率fs滑动，经过相关运算得到不同相对相位的相关运算结果；将计算的相关结果缓存，比较中心相关值是否满足归一化初同步阈值，然后比较前后半码片相关值，调整数据相位，完成伪码跟踪。本发明的一种基于数据滑动的K小段本地伪码相关运算电路的处理结构，简单有效的解决了数据比特1、0边界处相关值相互抵消造成漏同步的问题，并能够兼顾捕获时间和资源消耗，具有很强的兼容性。

本发明授权一种非相关扩频伪码同步的FPGA实现方法在权利要求书中公布了：1.一种非相关扩频伪码同步的FPGA实现方法，其特征在于，包括以下步骤： S1，获取参数，包括伪码速率fchip、采样速率fs、比特速率fb、小段数目K、小段伪码的长度N、归一化初同步阈值threshold；归一化同步阈值threshold设置为选取不大于K-1K； S2，根据步骤S1的参数计算参与相关运算的数据的采样点的采样位置；每轮参与相关运算的数据的采样点的采样位置设置为1，ceilfsfchip*1,ceilfsfchip*2，……，ceilfsfchip*i-1，i＝1,2,……，其中ceil[]表示向上取整； S3，计算所述小段数目K的小段本地伪码与步骤S2中的采样点数据的相关运算值，将K小段的相关值平方后累加，得到最终的相关值corr_fine； S4，将步骤S2中的采样数据按照采样速率fs滑动，经过步骤S3得到不同相对相位的相关运算结果； S5，将步骤S4计算的相关结果缓存，比较中心相关值是否满足归一化初同步阈值threshold，当数据滑动到中心相关值大于归一化初同步阈值时完成伪码捕获，然后比较前后半码片相关值，调整数据相位，完成伪码跟踪。

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