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龙图腾网获悉中国电子科技集团公司第三十四研究所申请的专利一种用于射频信号采样转换光传输设备延迟控制系统和方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119788187B 。

龙图腾网通过国家知识产权局官网在2025-10-21发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411835036.1，技术领域涉及：H04B10/2575；该发明授权一种用于射频信号采样转换光传输设备延迟控制系统和方法是由柯有强;柯心怡;宋文生;聂杨;姚君;陶庆肖设计研发完成，并于2024-12-13向国家知识产权局提交的专利申请。

本一种用于射频信号采样转换光传输设备延迟控制系统和方法在说明书摘要公布了：本发明涉及光纤通信技术领域，具体涉及一种用于射频信号采样转换光传输设备延迟控制系统和方法，包括发射机和接收机，所述发射机包括第一开关、ADC模块、第一FPGA模块、第一光模块、第一频综同步模块、第一波分复用器和第一延迟测量模块，所述接收机包括第二波分复用器、第二光模块、第二FPGA模块、DAC模块、功分器、第二开关、同步检测模块、第二频综同步模块和第二延迟测量模块；通过第二FPGA模块根据测量的延迟值，以接收机设置的系统延迟值为基准，调整第二FPGA模块的FIFO数据存储位置，使所有通道的传输延迟保持与发射机时间关系不变，调整结束后，第一FPGA模块和第二FPGA模块控制第一开关和第二开关接通射频输入输出，传输射频信号。

本发明授权一种用于射频信号采样转换光传输设备延迟控制系统和方法在权利要求书中公布了：1.一种用于射频信号采样转换光传输设备延迟控制系统，其特征在于； 包括发射机和接收机，所述发射机包括第一开关、ADC模块、第一FPGA模块、第一光模块、第一频综同步模块、第一波分复用器和第一延迟测量模块，所述接收机包括第二波分复用器、第二光模块、第二FPGA模块、DAC模块、功分器、第二开关、同步检测模块、第二频综同步模块和第二延迟测量模块； 所述第一开关分别与所述第一频综同步模块、所述ADC模块和第一FPGA模块连接，所述ADC模块分别与所述第一FPGA模块和所述第一频综同步模块连接，所述第一FPGA模块分别与所述第一光模块、所述第一频综同步模块和所述第一延迟测量模块连接，所述第一波分复用器分别与所述第一光模块、所述第一延迟测量模块和所述第二波分复用器连接，所述第一频综同步模块和所述第一延迟测量模块连接，所述第二波分复用器分别与所述第二光模块和所述第二延迟测量模块连接，所述第二FPGA模块分别与所述第二光模块、所述DAC模块、所述第二开关、所述同步检测模块、所述第二频综同步模块和所述第二延迟测量模块连接，所述DAC模块分别与所述功分器和所述第二频综同步模块连接，所述功分器分别与所述第二开关和所述同步检测模块连接，所述第二频综同步模块和所述第二延迟测量模块连接； 所述ADC模块的ADCLK连接所述第一频综同步模块采样时钟输出，CH1连接外部射频输入CH1，CH2连接所述第一开关C输出，JESD数据连接所述第一FPGA模块，所述第一FPGA模块的CLK4时钟连接所述第一频综同步模块输出，ctrl1连接所述第一开关C控制输入，GTX1连接所述第一光模块高速串行数据电信号输入，JESD连接所述ADC模块数据输出，SYN2R连接所述第一延迟测量模块输出，TRIG1连接外部主触发输入，TRIG2连接所述第一延迟测量模块和所述第一频综同步模块的触发信号输入，所述第一光模块的GTX1连接所述第一FPGA模块高速串行数据输出，光输出连接所述第一波分复用器的λ3、λ4输入，所述第一波分复用器的λ1、λ2接口连接所述第一延迟测量模块光接口，λ3、λ4接口连接所述第一光模块的光输出，COM口连接传输光缆，所述第一延迟测量模块的光接口连接所述第一波分复用器的λ1、λ2接口，RCLK连接所述第一频综同步模块恢复时钟输入，SYNA脉冲连接所述第一频综同步模块输出，SYN2R同步信号本地环回并连接所述第一FPGA模块和所述第一频综同步模块输入，所述第一频综同步模块的ADCLK连接所述ADC模块采样时钟输入，CLK4连接所述第一FPGA模块时钟输入，TRIG2触发输入连接所述第一FPGA触发输出，RCLK连接所述第一延迟测量模块恢复时钟输出，SYN2R连接所述第一延迟测量模块输出，SYNA同步调制信号输出连接所述第一开关B输入，SYNA脉冲连接延迟测量输入，所述第一开关的A接口连接外部射频输入CH2，B接口连接所述第一频综同步模块SYNA同步调制信号输出，ctrl1接口连接所述第一FPGA模块控制输出，所述第二波分复用器的COM接口连接传输光缆，λ3、λ4接口连接所述第二光模块光口，λ1、λ2接口连接所述第二延迟测量模块光口，所述第二光模块的光口连接所述波分复用器λ3、λ4接口，GTX2连接所述第二FPGA模块高速串行数据输入，所述第二FPGA模块的CLK3连接所述第二频综同步模块时钟输入输出，ctrl2连接所述第二开关控制输入，GTX2连接接口所述第二光模块电信号，JESD连接所述DAC模块采样数据输入，SYN1连接外部同步信号输入，SYN2、SYN2R连接所述第二延迟测量模块同步信号输入、输出，SYNAR脉冲连接所述同步检测模块的同步调制信号输出，TRIG2R连接所述第二延迟测量模块输出，所述DAC模块的CH1连接外部用户射频信号输出，CH2连接所述功分器输入，DACclk连接所述第二频综同步模块转换时钟输出，JESD连接所述第二FPGA模块采样数据输出，所述功分器的输入连接所述DAC模块CH2输出，2个输出分别连接所述第二开关A输入和所述同步检测模块输入，所述开关输入的输入连接所述功分器输出，输出连接外部CH2射频信号输出，ctrl2连接所述第二FPGA模块控制输出，所述同步检测模块的输入连接所述功分器输出，输出连接所述第二FPGA模块SYNAR脉冲输入，所述第二频综同步模块的CLK1连接外部参考时钟输入，CLK2连接所述第二延迟测量模块时钟输入，CLK3连接所述第二FPGA模块时钟输入输出，DACclk连接DAC转换时钟输入，所述第二延迟测量模块的CLK2连接所述第二频综同步模块同步时钟输出，SYN2、SYN2R连接所述第二FPGA模块同步信号输出、输入，TRIG2R输出连接所述第二FPGA模块触发信号输入，光接口连接所述第二波分复用器λ1、λ2接口。

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