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龙图腾网获悉哈尔滨工业大学申请的专利具有自适应调整同步时钟相位功能的HDLC接收器及运行方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120017239B 。

龙图腾网通过国家知识产权局官网在2025-10-21发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510220381.2，技术领域涉及：H04L7/033；该发明授权具有自适应调整同步时钟相位功能的HDLC接收器及运行方法是由刘大同;黄洪涛;孟升卫;王泓渊;段易从;宋善澳设计研发完成，并于2025-02-27向国家知识产权局提交的专利申请。

本具有自适应调整同步时钟相位功能的HDLC接收器及运行方法在说明书摘要公布了：本发明提出具有自适应调整同步时钟相位功能的HDLC接收器及运行方法，属于数据通信技术领域，解决传统的HDLC接收器无法自适应地调整时钟相位以适应不同的工作环境和信号变化的问题，其中HDLC接收器包括：同步时钟输入模块、串行数据输入模块、时钟移相器模块、相位差计算器模块、串并转换器模块、去零控制器模块、‘7E’检测器模块、接收数据编码模块、地址判断模块、CRC校验模块、功能设置寄存器模块、接收缓存区模块和状态寄存器模块；本发明设计的HDLC接收器中各模块之间相互独立，但通过时钟和数据等信号相互连接，确保了系统的灵活性和扩展性，在不同的应用场景中，可以根据需要调整不同模块的参数，以适应不同的通信环境。

本发明授权具有自适应调整同步时钟相位功能的HDLC接收器及运行方法在权利要求书中公布了：1.具有自适应调整同步时钟相位功能的HDLC接收器，其特征在于，所述一种具有自适应调整同步时钟相位功能的HDLC接收器的结构包括： 同步时钟输入模块、串行数据输入模块、时钟移相器模块、相位差计算器模块、串并转换器模块、去零控制器模块、‘7E’检测器模块、接收数据编码模块、地址判断模块、CRC校验模块、功能设置寄存器模块、接收缓存区模块和状态寄存器模块； 所述同步时钟输入模块用于接收输入的同步时钟； 所述串行数据输入模块用于接收输入的串行数据； 所述相位差计算器模块用于计算同步时钟和串行数据的相位差并传输至时钟移相器模块； 所述时钟移相器模块根据相位差对同步时钟进行移相处理，并将移相处理后的同步时钟和串行数据输入‘7E’检测器模块； 时钟移相器模块包括相位差输入子模块、相位差判断子模块、时钟延时时间计算子模块、同步时钟移相子模块、边沿检测与采样点计算子模块、采样点判断子模块和同步时钟输出子模块； 所述相位差输入子模块用于接收相位差计算器模块输出的相位差； 所述相位差判断子模块将相位差和预先储存的相位差阈值进行对比，若相位差大于阈值，则向时钟延时时间计算子模块发送触发信号，若相位差不大于阈值，则向同步时钟输出子模块发送信号，输出当前的同步时钟； 所述时钟延时时间计算子模块用于计算时钟的延时时间并传输至同步时钟移相子模块； 所述同步时钟移相子模块根据接收到的延时时间对同步时钟进行移相操作并传输至边沿检测与采样点计算子模块； 所述边沿检测与采样点计算子模块根据接收的移相后的同步时钟进行边沿检测并计算采样点在串行数据比特中的位置，将计算结果传输至采样点判断子模块； 所述采样点判断子模块判断采样点位置是否位于比特中心，若位于比特中心，则向同步时钟输出子模块发送信号，输出当前的同步时钟，若不位于比特中心，则向相位差计算器模块发送反馈信号，重新获取相位差数据并计算，直至采样点位置位于比特中心； 所述同步时钟输出子模块根据接收的信号，将对应的同步时钟传输至‘7E’检测器模块； 所述‘7E’检测器模块用于检测串行数据的有效帧头； 所述去零控制器模块用于对串行数据进行去零操作； 所述串并转换器模块将去零操作后的串行数据转换为并行数据并输入地址判断模块； 所述地址判断模块用于判断去零操作后的串行数据是否为有效帧； 当为有效帧时，所述接收数据编码器接收功能设置寄存器模块的指令，从串并转换器模块读入并行数据后存入接收缓冲区模块并对状态寄存器模块进行更新； 所述CRC校验模块用于对去零操作后的串行数据进行实时判读，在帧尾将判读结果通过接收数据编码器模块发送到状态寄存器模块。

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