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龙图腾网获悉芯思原微电子有限公司申请的专利一种寄存器间接访问电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119781829B 。

龙图腾网通过国家知识产权局官网在2025-10-28发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411917497.3，技术领域涉及：G06F9/30；该发明授权一种寄存器间接访问电路是由高挺挺;王杰;叶飞设计研发完成，并于2024-12-24向国家知识产权局提交的专利申请。

本一种寄存器间接访问电路在说明书摘要公布了：本发明涉及芯片设计，具体涉及一种寄存器间接访问电路，包括块使能产生装置和多个寄存器块读写装置，块使能产生装置和各寄存器块读写装置共享寄存器时钟、写数据、写使能、读使能、读写地址，块使能产生装置输出的块使能寄存器读数据和各寄存器块读写装置输出的寄存器块读数据相或后再经由一组D触发器打一拍后送到读数据上；本发明提供的技术方案能够有效克服现有技术所存在的难以在不拓宽地址总线宽度的情况下有效扩大寄存器寻址空间的缺陷。

本发明授权一种寄存器间接访问电路在权利要求书中公布了：1.一种寄存器间接访问电路，其特征在于：包括块使能产生装置和多个寄存器块读写装置，块使能产生装置和各寄存器块读写装置共享寄存器时钟、写数据、写使能、读使能、读写地址，块使能产生装置输出的块使能寄存器读数据和各寄存器块读写装置输出的寄存器块读数据相或后再经由一组D触发器打一拍后送到读数据上； 所述块使能产生装置包括块使能寄存器、第一寄存器时钟门控ICG1、第一等于比较器Q1、第一与门A1、第二与门A2、第一二选一选择器M1和第二等于比较器Q2，所述第一等于比较器Q1接入读写地址和预设的块使能寄存器地址，所述第一与门A1接入第一等于比较器Q1的输出端和写使能，所述第二与门A2接入第一等于比较器Q1的输出端和读使能，所述第一寄存器时钟门控ICG1接入寄存器时钟和第一与门A1的输出端，所述块使能寄存器接入第一寄存器时钟门控ICG1的输出端和写数据，所述第一二选一选择器M1接入第二与门A2的输出端、块使能寄存器输出的块使能寄存器值和0，所述第一二选一选择器M1输出块使能寄存器读数据，所述第二等于比较器Q2接入块使能寄存器输出的块使能寄存器值和预设的寄存器块基地址，所述第二等于比较器Q2输出与寄存器块对应的块使能； 所述寄存器块读写装置包括寄存器块、第三等于比较器Q3、第三与门A3、第二寄存器时钟门控ICG2、第一或门O1，以及与寄存器块内部存放寄存器数量相匹配的多组等于比较器、与门和二选一选择器，所述寄存器块内部存放多个寄存器，所述第三等于比较器Q3接入读写地址和预设的寄存器地址，所述第三与门A3接入第三等于比较器Q3的输出端、第二等于比较器Q2输出的块使能，以及写使能，所述第二寄存器时钟门控ICG2接入寄存器时钟和第三与门A3的输出端，所述寄存器块接入第二寄存器时钟门控ICG2的输出端、写数据、读写地址和预设的寄存器地址，所述寄存器块输出寄存器值； 等于比较器q1接入读写地址和预设的寄存器1地址，与门a1接入等于比较器q1的输出端、读使能和块使能，二选一选择器m1接入与门a1的输出端、寄存器块输出的寄存器1值和0，所述第一或门O1接入二选一选择器m1输出的寄存器1读数据，剩余各组的等于比较器、与门和二选一选择器与等于比较器q1、与门a1和二选一选择器m1的连接结构相同，所述第一或门O1输出寄存器块读数据。

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