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龙图腾网获悉芯行纪科技有限公司申请的专利用于优化数字逻辑电路布局的方法、设备及存储介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120449816B 。

龙图腾网通过国家知识产权局官网在2025-11-04发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510914292.8，技术领域涉及：G06F30/398；该发明授权用于优化数字逻辑电路布局的方法、设备及存储介质是由杨晓君;潘成龙;丁渭滨;张新城设计研发完成，并于2025-07-03向国家知识产权局提交的专利申请。

本用于优化数字逻辑电路布局的方法、设备及存储介质在说明书摘要公布了：本申请提供一种用于优化数字逻辑电路布局的方法、设备及存储介质，通过确定数字逻辑电路的第一布局，第一布局中包括多个宏单元和多个标准单元，确定相邻的宏单元之间形成的沟道，基于数字逻辑电路的优化目标，根据标准单元和沟道的位置，确定标准单元的目标步长参数，优化目标包括线长目标、密度目标和时序目标中的至少一个，基于目标步长参数，调整标准单元，以优化数字逻辑电路的布局。通过本申请的方法，可以实现数字逻辑电路的自动布局优化，减少了沟道对布局优化的影响，更进一步地提升了芯片的性能。

本发明授权用于优化数字逻辑电路布局的方法、设备及存储介质在权利要求书中公布了：1.一种用于优化数字逻辑电路布局的方法，其特征在于，包括： 确定所述数字逻辑电路的第一布局；其中，所述第一布局中包括多个宏单元和多个标准单元； 确定相邻的所述宏单元之间形成的沟道，包括：确定相邻的两个所述宏单元之间的间隔；响应于所述间隔的宽度小于宽度阈值，确定所述间隔为沟道；其中，所述宽度阈值根据所述宏单元的尺寸进行计算； 基于所述数字逻辑电路的优化目标，根据所述标准单元和所述沟道的位置，确定所述标准单元的目标步长参数；其中，所述优化目标包括线长目标、密度目标和时序目标中的至少一个； 基于所述目标步长参数，调整所述标准单元，以优化所述数字逻辑电路的布局； 其中，基于所述数字逻辑电路的优化目标，根据所述标准单元和所述沟道的位置，确定所述标准单元的目标步长参数，包括： 基于所述数字逻辑电路的优化目标，确定所述标准单元的初始步长参数； 根据所述标准单元和所述沟道的位置以及所述初始步长参数，确定步长系数； 根据所述初始步长参数和所述步长系数，确定所述目标步长参数； 其中，所述初始步长参数包括移动步长和移动方向，若所述标准单元位于目标区域且所述移动方向是远离所述第一布局的中心，则所述标准单元的所述步长系数设为小于1，若所述标准单元位于目标区域且所述移动方向是靠近所述第一布局的中心，则所述标准单元的所述步长系数设为大于或等于1； 所述目标区域是根据沟道在所述目标区域中的面积占比和或所述目标区域中的沟道数量而确定的。

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