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龙图腾网获悉广东赛昉科技有限公司申请的专利一种RISC-V指令集余数指令的实现方法及系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN112905236B 。

龙图腾网通过国家知识产权局官网在2025-11-07发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202110062056.X，技术领域涉及：G06F9/302；该发明授权一种RISC-V指令集余数指令的实现方法及系统是由刘权胜;余红斌;刘磊设计研发完成，并于2021-01-18向国家知识产权局提交的专利申请。

本一种RISC-V指令集余数指令的实现方法及系统在说明书摘要公布了：本发明涉及微处理器技术领域，具体涉及一种RISC‑V指令集余数指令的实现方法及系统，本发明对CPU乱序执行，指令从取指单元进入指令译码单元，进行指令译码；译码完成后的指令在重命名单元进行目的寄存器的重命名，同时对余数指令进行优化；若余数指令不满足优化条件时，重命名之后的指令进入保留站后，进入执行单元执行；执行完成后的指令通过重排序缓存提交，并释放在重命名阶段分配的除法指令编码缓存资源。本发明在重命名阶段通过增加余数指令加速单元实现余数指令的功能，当除法和余数指令配对出现时，通过余数指令的目的寄存器映射到除法指令写余数的物理寄存器，取到除法指令产生的余数，余数指令执行效率高。

本发明授权一种RISC-V指令集余数指令的实现方法及系统在权利要求书中公布了：1.一种RISC-V指令集余数指令的实现方法，其特征在于，所述方法包括以下步骤： S1对CPU乱序执行，指令从取指单元进入指令译码单元，进行指令译码； S2译码完成后的指令在重命名单元进行目的寄存器的重命名，同时对余数指令进行优化； S3若余数指令不满足优化条件时，重命名之后的指令进入保留站后，进入执行单元执行； S4执行完成后的指令通过重排序缓存提交，并释放在重命名阶段分配的除法指令编码缓存资源； 所述方法中，当除法和余数指令配对出现时，通过余数指令的目的寄存器映射到除法指令写余数的物理寄存器，取到除法指令产生的余数； 所述方法中，当除法指令进入重命名阶段时，当不存在配对的余数指令，除法指令根据编码，将除法指令信息写入除法指令编码缓存，除法指令写缓存时，先从缓存中找到空闲的位置，然后把除法指令的编码DIV_N_OP、保存配对余数指令结果的物理寄存地址div_phy_rem及除法指令除法指令的重排序ROB_ID写到缓存中，此时除法指令编码缓存的有效位valid置为1； 当余数指令进入重命名阶段时，余数指令编码REM_N_OP和除法指令编码DIV_N_OP进行匹配检查，根据除法指令DIV是和余数指令REM配对规则进行检查；如果余数指令比较命中，则将目的寄存器rem_rd的映射关系映射到rem_phy_reg，并且更新到目的寄存器重命名映射表RAT，余数指令执行完成，更新在重排序缓存中指令执行完成指示，并且释放除法指令编码缓存资源。

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