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龙图腾网获悉中陕核(西安)中子科技有限公司申请的专利一种基于FPGA的单芯电缆测井编码方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120487062B 。

龙图腾网通过国家知识产权局官网在2025-11-14发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510746791.0，技术领域涉及：E21B47/12；该发明授权一种基于FPGA的单芯电缆测井编码方法是由谭红建;李佳瑶;刘恒;闫星泉;王利;张鹏;雷腾;陆杰;李源;宋磊;席彪;栾江磊设计研发完成，并于2025-06-05向国家知识产权局提交的专利申请。

本一种基于FPGA的单芯电缆测井编码方法在说明书摘要公布了：本发明提供了一种基于FPGA的单芯电缆测井编码方法包括：检测原始发送信号的边沿是否变化；若原始发送信号的边沿发生变化，则通过两路脉冲信号对所述原始发送信号进行编码处理，得到正负电平相互抵消的最终输出信号。本发明将FPGA模块与外部驱动电路协同作用对原始发送信号进行编码处理，可以得到正负电平相互抵消的最终输出信号。本发明可以有效避免基线漂移产生毛刺对信号造成干扰，影响数据的准确性，解决石油测井单芯电缆传输中电平波动对信号的影响。

本发明授权一种基于FPGA的单芯电缆测井编码方法在权利要求书中公布了：1.一种基于FPGA的单芯电缆测井编码方法，其特征在于，包括： 检测原始发送信号的边沿是否变化； 若原始发送信号的边沿发生变化，则通过两路脉冲信号对所述原始发送信号进行编码处理，得到正负电平相互抵消的最终输出信号； 所述基于FPGA的单芯电缆测井编码方法利用基于FPGA的单芯电缆测井编码电路对原始发送信号进行编码，得到最终输出信号； 所述基于FPGA的单芯电缆测井编码电路包括FPGA模块和驱动电路；其中，所述FPGA模块输入所述原始发送信号、系统时钟信号和异步复位信号，并输出两路脉冲信号；所述驱动电路在所述两路脉冲信号的控制下，输出正负电平相互抵消的最终输出信号； 所述FPGA模块，用于检测所述原始发送信号的边沿是否变化，若是则产生2路脉冲信号pos和neg，对应输出VPOS和VNEG，其中，VPOS=3V，则VNEG=0，反之，VPOS=0V，则VNEG=3V，所述脉冲信号neg是检测到原始发送信号in边沿变化的同一个时钟周期内输出产生的脉冲信号，脉冲信号pos为在下一时钟周期内输出对边沿变化延迟响应产生的脉冲信号； 所述驱动电路包括电阻R1-R4，差分放大器U1、三极管N1-N2；其中，电阻R1的第一端输入VNEG，第二端连接差分放大器的负输入端和电阻R4的第一端；电阻R2的第一端输入VPOS，第二端连接差分放大器的正输入端和电阻R3的第一端，电阻R3的第二端连接电源VSS；电阻R4的第二端连接三极管N1和N2的发射极，差分放大器的输出端连接至三极管N1和N2的基极，三极管N1的集电极接+15V电压，三极管N2的集电极接-15V电压，三极管N1和N2的源极输出电平正负相抵消的最终输出信号。

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