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龙图腾网获悉电子科技大学申请的专利一种基于FPGA适用于多种SAR成像算法的多路并行数据处理系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120143156B 。

龙图腾网通过国家知识产权局官网在2025-11-21发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510329241.9，技术领域涉及：G01S13/90；该发明授权一种基于FPGA适用于多种SAR成像算法的多路并行数据处理系统是由李晋;闵锐;赵洪仪;赵灿;皮亦鸣设计研发完成，并于2025-03-19向国家知识产权局提交的专利申请。

本一种基于FPGA适用于多种SAR成像算法的多路并行数据处理系统在说明书摘要公布了：本发明公开了一种基于FPGA适用于多种SAR成像算法的多路并行数据处理系统，属于雷达成像信号技术领域。本发明所述系统适用于多种SAR成像算法的多路并行数据处理系统，共有三种不同的数据写入读出操作，通过参数灵活调整并且既可以使用单片DDR也可以使用多片DDR，这使本系统具有很强的普适性，适用于多种具有方位向距离向处理的SAR成像算法；中间数据处理过程进行八路并行处理保证了系统高速实时成像。

本发明授权一种基于FPGA适用于多种SAR成像算法的多路并行数据处理系统在权利要求书中公布了：1.一种基于FPGA适用于多种SAR成像算法的多路并行数据处理系统，其特征在于，包括串并转化模块、DDR状态控制模块、DDR和RAM数据乒乓转化模块； DDR状态控制模块用于完成对DDR的状态控制，共配置有四种状态，分别为：100表示DDR不进行读写操作；201表示DDR顺序写入读出数据；310表示DDR进行方位向到距离向的转置操作；411表示DDR进行距离向到方位向的转置操作； 记雷达回波数据的位宽为Nbits，横向是距离向、纵向是方位向，N为正整数；DDR一次读写的位宽为16Nbits； DDR的状态为01时，串并转化模块一次接收8Nbits的输入数据并转化为16Nbits数据，输入至DDR组状态控制模块；DDR组状态控制模块将16Nbits数据顺序存入DDR中，之后顺序读出16Nbits数据至RAM数据乒乓转化模块；RAM乒乓转换模块将16Nbits数据转化为8Nbits数据，之后8Nbits数据分成8路并行输出； DDR的状态为10时，输入数据的横向是方位向、纵向是距离向，串并转化模块接收8Nbits的输入数据并转化为16Nbits数据，输入到DDR组状态控制模块；DDR组状态控制模块将16Nbits数据转置存入DDR中，之后转置读出16Nbits至RAM数据乒乓转化模块，完成数据方位向到距离向的转置；RAM乒乓转换模块将16Nbits数据转化为8Nbits数据，8Nbits数据分成8路并行输出； DDR的状态为11时，输入数据的横向是距离向、纵向是方位向，串并转化模块接收8Nbits的输入数据并转化为16Nbits数据，输入到DDR组状态控制模块；DDR组状态控制模块将16Nbits数据转置存入DDR中，之后转置读出16Nbits至RAM数据乒乓转化模块，完成输入数据距离向到方位向的转置；RAM乒乓转换模块将16Nbits数据转化为8Nbits数据，8Nbits数据分成8路并行输出； DDR的状态为00时，DDR不执行任何操作。

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