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龙图腾网获悉北京航空航天大学申请的专利一种基于AES存内译码的查表电路、存储器和方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN113921050B 。

龙图腾网通过国家知识产权局官网在2025-12-19发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202111078741.8，技术领域涉及：G11C8/10；该发明授权一种基于AES存内译码的查表电路、存储器和方法是由张悦;王进凯;王宏羽;赵巍胜设计研发完成，并于2021-09-15向国家知识产权局提交的专利申请。

本一种基于AES存内译码的查表电路、存储器和方法在说明书摘要公布了：本发明实施例提供了一种基于AES存内译码的查表电路、存储器和方法，所述电路包括：电压时间差转换电路、数据输出电路和译码电路；电压时间差转换电路用于对两个存储单元所连接的字线施加不同电压使两个存储单元依次放电，根据两个存储单元的阻态和位线的放电速度不同形成对应电压上升时间不同的使能信号；数据输出电路用于根据使能信号的上升时间，使两个存内译码单元分别输出逻辑信号；译码电路用于根据两个存内译码单元分别输出的逻辑信号，生成查表地址，在不限制数据传输的带宽的情况下能够有效降低查表电路的时间和功耗。

本发明授权一种基于AES存内译码的查表电路、存储器和方法在权利要求书中公布了：1.一种基于AES存内译码的查表电路，其特征在于，所述电路包括电压时间差转换电路、数据输出电路和译码电路； 所述电压时间差转换电路用于对两个存储单元所连接的字线施加不同电压使两个存储单元依次放电，根据两个存储单元的阻态和位线的放电速度不同形成对应电压上升时间不同的使能信号； 所述数据输出电路用于根据所述使能信号的上升时间，使两个存内译码单元分别输出逻辑信号； 所述译码电路用于根据两个存内译码单元分别输出的逻辑信号，生成查表地址； 所述电压时间差转换电路包括放电控制单元和反相器； 所述放电控制单元用于对两个存储单元所连接的字线施加不同电压使两个存储单元以不同的放电速度放电，形成与两个存储单元的阻态和放电速度对应的放电电压； 所述反相器用于当所述放电电压达到预设的电压阈值时，输出对应上升时间的使能信号； 所述放电控制单元包括两个放电子单元； 其中，每个放电子单元包括第一放电电路、第二放电电路和电压输出电路； 所述第一放电电路包括第一电源端、第一开关元件、至少一个第一存储单元和第二开关元件； 所述第二放电电路包括第二电源端、第三开关元件、至少一个第二存储单元和第四开关元件； 所述电压输出电路包括第五开关元件和第六开关元件； 所述第一开关元件与第三开关元件的控制端分别连接输入第一预充信号的位线和输入第二预充信号的位线，第一端分别连接第一电源端和第二电源端，第二端分别连接第二开关元件的第一端和第四开关元件的第一端； 所述第二开关元件与第四开关元件的控制端分别连接输入第一放电信号的字线和输入第二放电信号的字线，第二端分别连接第一存储单元的信号输入端和第二存储单元的信号输入端； 所述至少一个第一存储单元的信号输出端与所述电压输出电路连接； 所述至少一个第二存储单元的信号输出端与所述电压输出电路连接； 所述第五开关元件和第六开关元件的控制端与第三电源端连接； 所述第五开关元件与第六开关元件的第一端分别与第一存储单元的信号输出端和第二存储单元的信号输出端连接，第二端均与输出使能信号的电压输出端连接； 所述第一开关元件响应于所述第一预充信号而导通以使所述第二开关元件的第一端与所述第一电源端导通，所述第二开关元件响应于所述第一放电信号而导通以使所述第一存储单元在所述第一电源端的作用下放电； 所述第三开关元件响应于所述第二预充信号而导通以使所述第四开关元件的第一端与所述第二电源端导通，所述第四开关元件响应于所述第二放电信号而导通以使所述第二存储单元在所述第二电源端的作用下放电。

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