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龙图腾网获悉苏州盛科通信股份有限公司申请的专利一种基于UVM的多进程之间的进程控制方法及装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114296900B 。

龙图腾网通过国家知识产权局官网在2025-12-23发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202111645268.7，技术领域涉及：G06F9/48；该发明授权一种基于UVM的多进程之间的进程控制方法及装置是由唐飞;任金超;金小飞设计研发完成，并于2021-12-29向国家知识产权局提交的专利申请。

本一种基于UVM的多进程之间的进程控制方法及装置在说明书摘要公布了：本发明揭示了一种基于UVM的多进程之间的进程控制方法及装置，所述方法包括：S1，每一个组件在设置的结束仿真时间内若持续没有采样到对应输出总线的输出信号之后，进入待结束状态；S2，确认其余各个组件是否均已进入了待结束状态，若其余组件未进入，则进入S3，若进入，则进入S4；S3，当前组件继续采样输出信号，若采样到，则进入S1，若未采样到则进入S2；S4，当所有组件均进入了待结束状态后，延迟一段配置的延迟时间，仿真测试结束。本发明增加了多个进程之间的协调控制作用，从而保证仿真平台在合适的时间点停止采样并结束仿真。

本发明授权一种基于UVM的多进程之间的进程控制方法及装置在权利要求书中公布了：1.一种基于UVM的多进程之间的进程控制方法，其特征在于，所述方法包括： S1，每一个组件在设置的结束仿真时间内若持续没有采样到对应输出总线的输出信号之后，进入待结束状态； S2，确认其余各个组件是否均已进入了待结束状态，若其余组件未进入，则进入S3，若进入，则进入S4； S3，当前组件继续采样输出信号，若采样到，则进入S1，若未采样到则进入S2； S4，当所有组件均进入了待结束状态后，延迟一段配置的延迟时间，仿真测试结束； 其中，所述方法的仿真环境适用于从模块级到系统级，直至芯片级的复用，所述模块级的仿真环境还包括为外部验证IP所预留的结束机制，所述为外部验证IP所预留的结束机制包括： S10，在设置的结束仿真时间内，外部验证IP处于可结束状态，且在结束仿真时间达到后进入待结束状态； S20，确认测试平台中其余各个组件是否均已进入了待结束状态，若其余组件未进入，则进入S30，若进入，则进入S40； S30，判断等待期间外部验证IP是否处于可结束状态，若是，则进入S10，若否则进入S20； S40，当所有组件均进入了待结束状态后，延迟一段配置的延迟时间，仿真测试结束。

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