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龙图腾网获悉武汉船舶通信研究所(中国船舶重工集团公司第七二二研究所)申请的专利基于RISC-V架构的祖冲之算法实现方法、协处理器和运算装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115865312B 。

龙图腾网通过国家知识产权局官网在2026-01-30发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211441592.1，技术领域涉及：H04L9/06；该发明授权基于RISC-V架构的祖冲之算法实现方法、协处理器和运算装置是由李晨琪;樊荣;万立;袁国材;袁刚;吴露露;叶耀文;王庆年;周浩宇;黄哲;黄秀;汪沛然;周思承;罗璋奇;张勋臣;高照;王江涛设计研发完成，并于2022-11-17向国家知识产权局提交的专利申请。

本基于RISC-V架构的祖冲之算法实现方法、协处理器和运算装置在说明书摘要公布了：本发明公开了基于RISC‑V架构的祖冲之算法实现方法、协处理器和运算装置，属于祖冲之算法实现技术领域。本发明利用硬件逻辑结构运算速度快以及软件编程灵活程度高的特点，将RISC‑V扩展指令集加入处理器的硬件逻辑结构中，使得处理器能够在指令集级别调用该扩展指令集，从而在增加处理器指令集丰富度的基础上提升处理器对于祖冲之算法的执行能力。本发明提出的面向祖冲之算法的RISC‑V扩展指令集具有良好的灵活性，开发人员能够根据是否存在对于祖冲之算法的需求，决定是否将该扩展指令集加入处理器的硬件逻辑结构，同时不改变处理器中其他部分的硬件逻辑结构。

本发明授权基于RISC-V架构的祖冲之算法实现方法、协处理器和运算装置在权利要求书中公布了：1.一种基于RISC-V架构的祖冲之算法实现方法，其特征在于，包括基于RISC-V架构定义的用于祖冲之算法的三条扩展指令：定义用于祖冲之算法的密钥装入操作的ZUCSET指令、用于祖冲之算法初始化阶段操作的ZUCINIT指令、用于祖冲之算法工作阶段1和工作阶段2操作的ZUCWORK指令；三条扩展指令均为基于RV32R-type指令格式，操作码选择custom-0指令类型； 所述ZUCSET指令的编码格式如下： 指令的第0位至第6位区间为opcode字段，其值为0001011，用于标志采用custom-0指令组； 指令的第7位至第11位区间为rd字段，其值为目的寄存器rd对应索引，用于标志密钥装入操作是否成功； 指令的第12位至第14位区间为funct3字段，其值为000，用于作为三条扩展指令的分组码； 指令的第15位至第19位区间为rs1字段，其值为源寄存器rs1对应索引，用于存放当前执行阶段的祖冲之算法所需密钥key的部分值； 指令的第20位至第24位区间为rs2字段，其值为源寄存器rs2对应索引，用于存放当前执行阶段的祖冲之算法所需初始向量iv的部分值； 指令的第25位至第31位区间为funct7字段，编码格式为01111，其中，第30位的1，用于标志该值编码为ZUCSET指令，二进制数对应十进制数字pt，用于标志密钥装入操作的当前执行阶段； 所述ZUCINIT指令的编码格式如下： 指令的第0位至第6位区间为opcode字段，其值为0001011，用于标志采用custom-0指令组； 指令的第7位至第11位区间为rd字段，其值为目的寄存器rd对应索引，用于写回指令执行时产生的运算结果； 指令的第12位至第14位区间为funct3字段，其值为000，用于作为三条扩展指令的分组码； 指令的第15位至第19位区间为rs1字段，其值为00000； 指令的第20位至第24位区间为rs2字段，其值为00000； 指令的第25位至第31位区间为funct7字段，编码格式为0001111，用于标记该值编码为ZUCINIT指令； 所述ZUCWORK指令的编码格式如下： 指令的第0位至第6位区间为opcode字段，其值为0001011，用于标志采用custom-0指令组； 指令的第7位至第11位区间为rd字段，其值为目的寄存器rd对应索引，用于写回指令执行时产生的运算结果； 指令的第12位至第14位区间为funct3字段，其值为000，用于作为三条扩展指令的分组码； 指令的第15位至第19位区间为rs1字段，其值为00000； 指令的第20位至第24位区间为rs2字段，其值为00000； 指令的第25位至第31位区间为funct7字段，编码格式为0000111，用于标记该值编码为ZUCWORK指令。

如需购买、转让、实施、许可或投资类似专利技术，可联系本专利的申请人或专利权人武汉船舶通信研究所(中国船舶重工集团公司第七二二研究所)，其通讯地址为：430205 湖北省武汉市江夏区藏龙岛3号；或者联系龙图腾网官方客服，联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。

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