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龙图腾网获悉西安微电子技术研究所申请的专利一种基于替代链路宽度的PCIe接口电路验证装置及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115270673B 。

龙图腾网通过国家知识产权局官网在2026-02-13发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210880120.X，技术领域涉及：G06F30/331；该发明授权一种基于替代链路宽度的PCIe接口电路验证装置及方法是由翟宝峰;王蕊琪;王剑峰;杨靓设计研发完成，并于2022-07-25向国家知识产权局提交的专利申请。

本一种基于替代链路宽度的PCIe接口电路验证装置及方法在说明书摘要公布了：本发明公开了一种基于替代链路宽度的PCIe接口电路验证装置及方法，通过在验证FPGA的控制器和PHY之间的PIPE接口之间增加通路转换装置，高效方便的实现了多通路PCIe接口电路的硬件验证，有效解决了现有技术在多通路和多端口PCIe接口电路硬件验证中遇到的问题，本发明提供的一种基于替代链路宽度的PCIe接口电路硬件验证方法以极小的资源极大的降低了验证FPGA中多通路PCIe接口电路的控制器和应用逻辑的工作频率，可轻松实现PCIe接口电路的验证。

本发明授权一种基于替代链路宽度的PCIe接口电路验证装置及方法在权利要求书中公布了：1.一种基于替代链路宽度的PCIe接口电路验证方法，其特征在于，包括： 识别从FPGA的PHY接收到的信号类型，将信号类型通过data_type[2:0]信号表示为7类包序列；将包序列根据指示信号输出的不同状态进行转换，转换后包序列的格式、信息和位宽符合待验证PCIe控制器接口要求，将包序列送入至待验证PCIe控制器的PIPE接口； 接收待验证PCIe控制器的PIPE接口输出的数据信号，根据指示信号输出的不同状态将信号转换，转换后信号指示的7种包序列格式、信息和位宽符合FPGA的PHY的PIPE接口类型，将转换后的包序列发送；所述7类包序列包括物理层包PLP、数据链路层包DLLP和事务层包TLP；所述物理层包PLP包括链路训练有序集TS1、链路训练有序集TS2、时钟补偿有序集SKIP、快速训练有序集FTS和电气闲序列EIEOS； 在验证FPGA中待验证电路的PCIe控制器和FPGA的PHY之间的PIPE接口之间增加通路转换装置； 将待验证电路的PCIe控制器的PIPE接口输出的控制信号或状态信号转换，转换后控制信号或状态信号为符合FPGA的PHY的PIPE接口要求的接收信号，或者是FPGA的PHY的PIPE接口输出的控制信号或状态信号转换为符合待验证PCIe控制器的PIPE接口的输入信号。

如需购买、转让、实施、许可或投资类似专利技术，可联系本专利的申请人或专利权人西安微电子技术研究所，其通讯地址为：710000 陕西省西安市雁塔区太白南路198号；或者联系龙图腾网官方客服，联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。

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