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龙图腾网获悉华为技术有限公司申请的专利一种存算一体电路、芯片系统及电子设备获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115982092B 。

龙图腾网通过国家知识产权局官网在2026-02-13发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202111205493.9，技术领域涉及：G06F15/78；该发明授权一种存算一体电路、芯片系统及电子设备是由吴志航;倪磊滨设计研发完成，并于2021-10-15向国家知识产权局提交的专利申请。

本一种存算一体电路、芯片系统及电子设备在说明书摘要公布了：本申请公开了一种存算一体电路，用于以较小面积与功耗实现存算一体的复数乘累加计算。该算一体电路包括至少一个存算子阵列和至少一个乘累加MAC处理电路，其中，每个存算子阵列中包括按照n行m列排布的n*m个存算单元，其中，每个存算单元连接一组行信号线和一组列信号线，一组行信号线连接位于同一行上的m个存算单元，一组列信号线连接位于同一列上的n个存算单元，以及对应的目标MAC处理电路。每个存算单元用于计算第一复数的实部和虚部与第二复数的实部和虚部，以及第二复数的虚部的反相数据的乘积，以得到第一乘积结果和第二乘积结果，目标MAC处理电路用于对多个第一乘积结果和多个第二乘积结果做累加运算。

本发明授权一种存算一体电路、芯片系统及电子设备在权利要求书中公布了：1.一种存算一体电路，其特征在于，所述存算一体电路包括存算阵列和数据处理电路，所述存算阵列包括至少一个存算子阵列，其中，每个存算子阵列中包括按照n行m列排布的n*m个存算单元，所述数据处理电路包括至少一个乘累加MAC处理电路，所述至少一个存算子阵列与所述至少一个MAC处理电路一一对应，所述n和m为大于1的整数； 每个存算单元连接一组行信号线和一组列信号线，所述一组行信号线连接位于同一行上的m个存算单元，所述一组列信号线连接位于同一列上的n个存算单元，以及所述n个存算单元所在的存算子阵列对应的目标MAC处理电路； 所述每个存算单元用于从所连接的一组行信号线分别接收第一复数的第一实部比特数据和第一虚部比特数据，并与第二复数的第二实部比特数据，以及目标比特数据的相关数据进行运算，以得到第一乘积结果和第二乘积结果，所述第二实部比特数据和所述目标比特数据存储于所述存算单元中，所述目标比特数据包括第二虚部比特数据或所述第二虚部比特数据的反相数据，所述目标比特数据的相关数据包括所述第二虚部比特数据和所述第二虚部比特数据的反相数据； 所述目标MAC处理电路用于从所连接的m组列信号线接收多个所述第一乘积结果和多个所述第二乘积结果，并对所述多个所述第一乘积结果进行累加以得到第一输出数据，以及对所述多个所述第二乘积结果进行累加以得到第二输出数据； 所述每个存算单元包括第一计算单元、第二计算单元、第三计算单元、第四计算单元，第一存储单元和第二存储单元； 所述第一存储单元连接所述第一计算单元和所述第三计算单元，所述第二存储单元连接所述第二计算单元和所述第四计算单元； 所述一组行信号线中的至少一条第一行信号线连接所述第一计算单元和所述第四计算单元，至少一条第二行信号线连接所述第二计算单元和所述第三计算单元，所述一组列信号线中的第一列信号线连接所述第一计算单元和所述第二计算单元，第二列信号线连接所述第三计算单元和所述第四计算单元； 所述第一存储单元用于存储所述目标比特数据，所述第二存储单元用于存储所述第二实部比特数据；若所述目标比特数据为第二虚部比特数据，所述第一存储单元用于对所述第二虚部比特数据取反得到所述第二虚部比特数据的反相数据后输出，若所述目标比特数据为第二虚部比特数据的反相数据，所述第一存储单元用于对所述第二虚部比特数据的反相数据取反得到所述第二虚部比特数据后再输出。

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