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龙图腾网获悉成都维德青云电子有限公司申请的专利并串转换电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121116879B 。

龙图腾网通过国家知识产权局官网在2026-02-13发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511666191.X，技术领域涉及：G06F13/38；该发明授权并串转换电路是由王元圣;蒙奕帆设计研发完成，并于2025-11-14向国家知识产权局提交的专利申请。

本并串转换电路在说明书摘要公布了：本申请涉及集成电路技术领域，公开了一种并串转换电路。本申请的并串转换电路包括：并行数据存储单元、奇偶数据交换单元、移位单元以及选择输出单元，并行数据存储单元连接并行数据输入端和并行时钟信号端，奇偶数据交换单元连接于并行数据存储单元和移位单元之间，用于根据第一选择控制信号将并行数据直接输出或者将并行数据进行奇偶数据位的交换后输出；移位单元连接奇偶数据交换单元、选择输出单元以及串行时钟信号端；选择输出单元连接移位单元、串行时钟信号输入端以及串行数据输出端，用于随串行时钟信号的高低电平依次串行输出移位数据中的各位数据。本申请技术方案可以动态配置具体的并串转换模式，提高了FPGA的IO接口使用的灵活性。

本发明授权并串转换电路在权利要求书中公布了：1.一种并串转换电路，其特征在于，包括：并行数据存储单元、奇偶数据交换单元、移位单元以及选择输出单元，其中，所述并行数据存储单元连接并行数据输入端和并行时钟信号端，用于随所述并行时钟信号端输入的并行时钟信号存储待转换并行数据； 所述奇偶数据交换单元连接于所述并行数据存储单元和所述移位单元之间，用于根据第一选择控制信号将所述并行数据存储单元输出的并行数据直接输出或者将所述并行数据存储单元输出的并行数据进行奇偶数据位的交换后输出，其中，所述第一选择控制信号与所述待转换并行数据的位宽相关； 所述移位单元连接所述奇偶数据交换单元、所述选择输出单元以及串行时钟信号端，用于根据第二选择控制信号和第三选择控制信号随所述串行时钟信号端输入的串行时钟信号将所述奇偶数据交换单元输出的并行数据进行数据移位，得到移位数据，所述第二选择控制信号和所述第三选择控制信号是基于可配置的状态机生成的； 所述选择输出单元连接所述移位单元、所述串行时钟信号输入端以及串行数据输出端，用于随所述串行时钟信号的高低电平依次串行输出所述移位数据中的各位数据。

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