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龙图腾网获悉上海联影微电子科技有限公司申请的专利多芯片间的存储控制电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115509969B 。

龙图腾网通过国家知识产权局官网在2026-02-27发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211201932.3，技术领域涉及：G06F13/16；该发明授权多芯片间的存储控制电路是由蒋忠平设计研发完成，并于2022-09-29向国家知识产权局提交的专利申请。

本多芯片间的存储控制电路在说明书摘要公布了：本申请涉及一种多芯片间的存储控制电路，通过将多个处理芯片均与存储芯片连接，通过多个处理芯片之间的通用输入输出接口相互传输指示信号，完成多个处理芯片对存储芯片的访问权限控制，能够保证多个处理芯片合理有序的共用一个存储芯片，实现一个存储芯片为多个处理芯片提供数据，在进行芯片封装时能够只采用一个封装基板，且由于多个处理芯片共用一个存储芯片，能够减少封装基板上封装芯片的数量，在保证提供同等功能的情况下，减小封装体积。

本发明授权多芯片间的存储控制电路在权利要求书中公布了：1.一种多芯片间的存储控制电路，其特征在于，包括： 存储芯片； 第一处理芯片和第二处理芯片，所述第一处理芯片的通用输入输出接口与所述第二处理芯片的通用输入输出接口相连接； 低有效三态缓冲器，所述低有效三态缓冲器的输入端、输出端分别连接所述第一处理芯片的串行外设输出接口、所述存储芯片的串行外设输入接口； 以及高有效三态缓冲器，所述高有效三态缓冲器的输入端、输出端分别连接所述第二处理芯片的串行外设输出接口、所述存储芯片的串行外设输入接口； 所述低有效三态缓冲器和所述高有效三态缓冲器的使能端，均连接在所述第一处理芯片的通用输入输出接口与所述第二处理芯片的通用输入输出接口之间的电路； 所述存储芯片的串行外设输出接口分别与所述第一处理芯片和所述第二处理芯片的串行外设输入接口连接； 在所述第一处理芯片的通用输入输出接口向所述第二处理芯片的通用输入输出接口传输低电平的情况下，所述低有效三态缓冲器处于导通状态，所述高有效三态缓冲器处于阻断状态，以使所述第一处理芯片向所述存储芯片发送访问，接收所述存储芯片输出的数据； 在所述第一处理芯片的通用输入输出接口向所述第二处理芯片的通用输入输出接口传输高电平的情况下，所述低有效三态缓冲器处于阻断状态，所述高有效三态缓冲器处于导通状态，以使所述第二处理芯片向所述存储芯片发送访问，接收所述存储芯片输出的数据。

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