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龙图腾网获悉中国航天科工飞航技术研究院(中国航天海鹰机电技术研究院)申请的专利一种用于EMIF并行总线的实时故障诊断和保护方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116931474B 。

龙图腾网通过国家知识产权局官网在2026-03-24发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210372062.X，技术领域涉及：G05B19/042；该发明授权一种用于EMIF并行总线的实时故障诊断和保护方法是由杨鑫;王海亮;陈玫志;余宝伟;陈松;胡良辉设计研发完成，并于2022-04-11向国家知识产权局提交的专利申请。

本一种用于EMIF并行总线的实时故障诊断和保护方法在说明书摘要公布了：本发明提供了一种用于EMIF并行总线的实时故障诊断和保护方法，该方法包括：将FPGA中的内存区域划分为控制字地址域和状态字地址域；利用DSP向FPGA发送DSP写生命信号，FPGA将读取到的DSP写生命信号写入控制字地址域的第一预设地址内形成FPGA写生命信号，并且根据FPGA写生命信号生成FPGA读生命信号，存储在状态字地址域的第二预设地址内；利用DSP读取FPGA读生命信号形成DSP读生命信号；根据DSP发送的DSP写生命信号和读取的DSP读生命信号进行实时故障诊断并且在诊断出故障时采取第一类保护措施。与现有技术相比，本发明的技术方案能够解决现有技术中无法对DSP和FPGA之间的EMIF并行总线通信故障进行实时诊断和保护，导致牵引变流系统的安全性较低的技术问题。

本发明授权一种用于EMIF并行总线的实时故障诊断和保护方法在权利要求书中公布了：1.一种用于EMIF并行总线的实时故障诊断和保护方法，其特征在于，所述EMIF并行总线一端连接DSP，另一端连接FPGA，所述FPGA与牵引变流功率电路连接，所述EMIF并行总线包括地址总线、数据总线和控制总线，所述方法包括： 根据所述地址总线的地址宽度和所述数据总线的数据宽度将所述FPGA中的内存区域划分为控制字地址域和状态字地址域； 利用所述DSP通过所述地址总线、所述数据总线和所述控制总线向所述FPGA发送DSP写生命信号，所述FPGA将读取到的DSP写生命信号写入所述控制字地址域的第一预设地址内形成FPGA写生命信号，并且根据所述第一预设地址内写入的FPGA写生命信号生成FPGA读生命信号，所述FPGA读生命信号存储在所述状态字地址域的第二预设地址内，其中，利用所述DSP通过所述地址总线、所述数据总线和所述控制总线向所述FPGA发送DSP写生命信号包括：在定时时间达到预设控制周期时，判断DSP写生命信号的值是否小于第一预设阈值，如果是，则将所述DSP写生命信号的值加1后通过所述地址总线、所述数据总线和所述控制总线发送至所述FPGA，且将DSP写生命信号的值加1后赋值给DSP写生命信号，如果否，则将所述DSP写生命信号的值清零后通过所述地址总线、所述数据总线和所述控制总线发送至所述FPGA； 利用所述DSP通过所述地址总线、所述数据总线和所述控制总线读取所述状态字地址域的第二预设地址内的FPGA读生命信号形成DSP读生命信号； 根据所述DSP发送的DSP写生命信号和读取的DSP读生命信号进行实时故障诊断并且在诊断出故障时采取第一类保护措施； 利用所述FPGA根据所述第一预设地址内的FPGA写生命信号进行实时故障诊断并且在诊断出故障时采取第二类保护措施，包括：判断当前写入所述第一预设地址内的FPGA写生命信号与上一次写入所述第一预设地址内的FPGA写生命信号之间的关系，如果两个信号的差值的绝对值为1或者两个信号的和等于所述第一预设阈值，则诊断为无故障，FPGA端故障计时变量清零，且FPGA端故障标志清零；如果两个信号的差值的绝对值不等于1并且两个信号的和不等于所述第一预设阈值，则所述FPGA端故障计时变量增加1直至达到第二预设阈值时诊断为发生故障，所述FPGA端故障标志置位。

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