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龙图腾网获悉南京大学申请的专利一种基于RISC-V指令集拓展的加速计算装置及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116245149B 。

龙图腾网通过国家知识产权局官网在2026-03-31发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211636249.2，技术领域涉及：G06N3/063；该发明授权一种基于RISC-V指令集拓展的加速计算装置及方法是由王中风;黄龙威;方超;林军设计研发完成，并于2022-12-20向国家知识产权局提交的专利申请。

本一种基于RISC-V指令集拓展的加速计算装置及方法在说明书摘要公布了：本申请提供了一种基于RISC‑V指令集拓展的加速计算装置与方法，包括：RISC‑V微处理器核模块，被配置为控制量化神经网络的读写，存储指令和小规模数据，进行取指操作，并生成自定义指令；协处理器核模块，被配置为执行来自RISC‑V微处理器核模块发送的自定义指令；存储模块，通过AXI总线与AXI互联设备相连接，其中，所述存储模块包括：DDR存储器，被配置为存储大批量的用于生成自定义指令的量化神经网络参数；DDR控制器，被配置为控制DDR存储器的读写，以解决目前的CNN模型的计算量以及参数量都十分庞大，导致模型在运行过程中需要占用大量内存，同时消耗超高算力的问题。

本发明授权一种基于RISC-V指令集拓展的加速计算装置及方法在权利要求书中公布了：1.一种基于RISC-V指令集拓展的加速计算装置，其特征在于，包括： RISC-V微处理器核模块1，通过AXI总线与AXI互联设备相连接，被配置为控制量化神经网络的读写，存储指令和小规模数据，进行取指操作，并生成自定义指令； 协处理器核模块2，与所述RISC-V微处理器核模块1通信连接，通过所述AXI总线与所述AXI互联设备相连接，被配置为执行来自所述RISC-V微处理器核模块1发送的自定义指令； 存储模块3，通过所述AXI总线与所述AXI互联设备相连接，其中，所述存储模块3包括： DDR存储器31，被配置为存储大批量的用于生成自定义指令的量化神经网络参数； DDR控制器32，被配置为控制DDR存储器31的读写； 所述协处理器核模块2，包括：译码单元21、状态单元22、执行单元23；状态单元22，与所述译码单元21通信连接；所述状态单元22包括： 第一状态单元221，被配置为当自定义指令为labuf指令时，将labuf指令通过所述AXI总线从所述存储模块3中读取数据，将rs1中指示的首地址对应的连续的数据写入片上分配的空间buffer_a；buffer_a存储的低3位被定义为量化位宽选择信号，labuf指令通过rs2中指示的首地址读取量化位宽选择信号； 第二状态单元222，与所述第一状态单元221通信连接，被配置为当自定义指令为lbbuf指令时，将lbbuf指令通过所述AXI总线从所述存储模块3中读取数据，将rs1中指示的首地址对应的连续的数据写入片上分配空间的buffer_b； 第三状态单元223，与所述第二状态单元222通信连接，被配置为当自定义指令为matrix指令时，将matrix指令从buffer_a读取量化位宽后，将buffer_a和buffer_b的数据经过MUX补零后输入脉动阵列计算矩阵乘法并在累加后存入输出buffer； 第四状态单元224，被配置为当自定义指令为sbuf指令时，将sbuf指令通过所述AXI总线将outputbuffer中的数据写入rs1中指示的首地址对应的连续的所述DDR存储器31中； 所述执行单元23包括： 加速器231，被配置为进行多精度量化神经网络计算； 其中加速器231包括：参数化可配置的脉动阵列、2个用于暂存输入数据的片上存储空间buffer_a和buffer_b，1个用于暂存输出数据的片上存储空间outputbuffer，1个累加器，1个用于控制数据输入的计数器和2个用于在数据进入脉动阵列前进行数据排布和补零的MUX。

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