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龙图腾网获悉惠科股份有限公司申请的专利Mini直显电路的驱动系统、液晶显示面板及显示装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN118397959B 。

龙图腾网通过国家知识产权局官网在2026-04-03发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202410666120.9，技术领域涉及：G09G3/32；该发明授权Mini直显电路的驱动系统、液晶显示面板及显示装置是由林芸;袁海江设计研发完成，并于2024-05-23向国家知识产权局提交的专利申请。

本Mini直显电路的驱动系统、液晶显示面板及显示装置在说明书摘要公布了：本申请实施例涉及一种Mini直显电路的驱动系统、液晶显示面板及显示装置，包括：电源模块、控制模块、第一驱动模块、第二驱动模块和显示模块；电源模块分别与控制模块、第一驱动模块、第二驱动模块和显示模块连接；控制模块的第一输出端连接至第一驱动模块的输入端，控制模块的第二输出端连接至第二驱动模块的输入端；第一驱动模块的输出端连接至显示模块的第一输入端；第二驱动模块的输出端连接至显示模块的第二输入端。采用FPGA芯片作为控制模块，并通过第一驱动模块进行电压转化，通过第二驱动模块对显示面板的像素数据进行放大输出，实现驱动Mini直显电路的目的。由此，可以实现快速驱动Mini直显电路的技术效果。

本发明授权Mini直显电路的驱动系统、液晶显示面板及显示装置在权利要求书中公布了：1.一种Mini直显电路的驱动系统，应用于液晶显示面板，其特征在于，包括： 电源模块、控制模块、第一驱动模块、第二驱动模块和显示模块； 所述电源模块分别与所述控制模块、所述第一驱动模块、所述第二驱动模块和所述显示模块连接，用于为每个模块提供电能； 所述控制模块的第一输出端连接至所述第一驱动模块的输入端，所述控制模块的第二输出端连接至所述第二驱动模块的输入端，所述控制模块用于向所述第一驱动模块输出扫描控制信号，以及所述控制模块用于向所述第二驱动模块输出像素控制信号； 所述第一驱动模块的输出端连接至所述显示模块的第一输入端，所述第一驱动模块用于向所述显示模块输出扫描驱动信号，已使所述显示模块基于所述扫描驱动信号开启显示面板的行扫描操作； 所述第二驱动模块的输出端连接至所述显示模块的第二输入端，所述第二驱动模块用于向所述显示模块输出像素驱动信号，已使所述显示模块基于所述像素驱动信号显示画面； 所述控制模块为现场可编程门阵列FPGA芯片，基于所述FPGA芯片向所述第一驱动模块输出写入控制信号，已使所述第一驱动模块向所述显示模块输出行扫描信号；以及基于所述FPGA芯片向所述第二驱动模块输出像素控制信号，已使所述第二驱动模块输出像素驱动信号； 所述第二驱动模块包括：数模转换单元和运放单元； 所述数模转换单元的第一输入端连接至所述控制模块的第二输出端，所述数模转换单元的第二输入端连接至所述控制模块的第三输出端，所述数模转换单元的第三输入端连接至所述控制模块的第四输出端； 所述数模转换单元的第一输出端连接至所述运放单元的第一输入端，所述数模转换单元的第二输出端连接至所述运放单元的第二输入端，所述数模转换单元的第三输出端连接至所述运放单元的第三输入端，所述数模转换单元用于对所述控制模块输出的模拟的像素控制信号转换成数字的像素控制信号； 所述运放单元的输出端连接至所述显示模块的第二输入端，所述运放单元用于将所述数模转换单元输出的数字的像素控制信号进行放大处理后输出数字的像素驱动信号； 所述数模转换单元包括：第一数模转换子单元、第二数模转换子单元和第三数模转换子单元； 所述第一数模转换子单元的输入端连接至所述控制模块的第二输出端，所述第一数模转换子单元的输出端连接至所述运放单元的第一输入端； 所述第二数模转换子单元的输入端连接至所述控制模块的第三输出端，所述第二数模转换子单元的输出端连接至所述运放单元的第二输入端； 所述第三数模转换子单元的输入端连接至所述控制模块的第四输出端，所述第一数模转换子单元的输出端连接至所述运放单元的第三输入端； 所述第一数模转换子单元将接收所述控制模块输出的三原色中第一原色数据信号，以及所述第一数模转换子单元将所述第一原色数据信号输入至所述运放单元进行放大处理；所述第二数模转换子单元将接收所述控制模块输出的三原色中第二原色数据信号，以及所述第二数模转换子单元将所述第二原色数据信号输入至所述运放单元进行放大处理；所述第三数模转换子单元将接收所述控制模块输出的三原色中第三原色数据信号，以及所述第三数模转换子单元将所述第三原色数据信号输入至所述运放单元进行放大处理； 所述运放单元包括：第一运放子单元、第二运放子单元和第三运放子单元，所述第一运放子单元、所述第二运放子单元和所述第三运放子单元分别用于向所述显示模块输出三原色中的一种像素驱动信号； 所述第一运放子单元的输入端连接至所述数模转换单元的第一输出端，所述第一运放子单元的输出端连接至所述显示模块的第二输出端； 所述第二运放子单元的输入端连接至所述数模转换单元的第二输出端，所述第二运放子单元的输出端连接至所述显示模块的第二输出端； 所述第三运放子单元的输入端连接至所述数模转换单元的第三输出端，所述第三运放子单元的输出端连接至所述显示模块的第二输出端； 其中，所述FPGA芯片通过第一时钟信号输出第一原色数据信号，通过第二时钟信号输出第二原色数据信号，通过第三时钟信号输出第三原色数据信号。

如需购买、转让、实施、许可或投资类似专利技术，可联系本专利的申请人或专利权人惠科股份有限公司，其通讯地址为：518108 广东省深圳市宝安区石岩街道石龙社区工业二路1号惠科工业园厂房1栋一层至三层、五至七层, 6栋七层；或者联系龙图腾网官方客服，联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。

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