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龙图腾网获悉重庆中科芯亿达电子有限公司申请的专利一种单线串行通信芯片及单线串行通信方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119883978B 。

龙图腾网通过国家知识产权局官网在2026-04-03发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411852701.8，技术领域涉及：G06F13/38；该发明授权一种单线串行通信芯片及单线串行通信方法是由罗新雨;张瑞涛设计研发完成，并于2024-12-16向国家知识产权局提交的专利申请。

本一种单线串行通信芯片及单线串行通信方法在说明书摘要公布了：本发明提供了一种单线串行通信芯片及单线串行通信方法。单线串行通信芯片包括半双工接口模块、并转串模块、寄存器、计数器和状态机，状态机根据寄存器的数据存储状态以及半双工接口模块接收的外部输入信号分析当前的数据传输需求，从而选择对应的工作模式指示其它模块将寄存器中的数据，如初始芯片数据，输出到外部单片机。其中，半双工接口模块与外部单片机之间连接为单线连接即可实现单线串行通信芯片与外部单片机之间的通信，在PCB板上实现本实施例的单线串行通信芯片时，相比于基于I2C协议和SPI协议的芯片，占用面积更小，还可显著减少引脚数量。

本发明授权一种单线串行通信芯片及单线串行通信方法在权利要求书中公布了：1.一种单线串行通信芯片，其特征在于，包括半双工接口模块、并转串模块、寄存器、计数器和状态机； 所述状态机与所述寄存器、所述计数器、所述半双工接口模块连接，所述寄存器还与所述并转串模块连接，所述并转串模块还与所述计数器和所述半双工接口模块连接，所述半双工接口模块与外部单片机连接； 所述寄存器，用于将初始芯片数据以并行数据的格式进行存储； 所述计数器，基于半双工接口模块的时钟信号进行计数，生成计数值； 所述并转串模块，用于将所述初始芯片数据转换为串行数据的格式获得待用芯片数据，并根据所述计数器生成的计数值，将所述待用芯片数据输出到所述半双工接口模块； 所述半双工接口模块，包括信号输出支路和信号输入支路；所述信号输入支路和所述信号输入支路均与外部单片机连接，接收来自外部单片机的外部输入信号，发送所述待用芯片数据；所述信号输出支路与所述状态机和所述并转串模块连接，接收所述并转串模块生成的计数值，所述状态机通过所述信号输出支路检测所述时钟信号； 所述状态机用于根据所述寄存器的数据存储状态以及所述半双工接口模块接收的外部输入信号，指示所述半双工接口模块、并转串模块和计数器向外部单片机输出所述待用芯片数据，包括： 若所述半双工接口模块没有接收到所述外部输入信号，且所述寄存器的数据存储状态表示存在待更新至外部单片机的目标数据，则所述状态机进入数据更新模式，所述数据更新模式用于指示所述半双工接口模块、并转串模块和计数器按照第一工作时序将所述目标数据转换为待用芯片数据并输出至外部单片机，完成数据更新； 若所述半双工接口模块接收到所述外部输入信号，且所述外部输入信号为预设类型时，则所述状态机进入强制读取模式，所述强制读取内模式用于指示所述半双工接口模块、并转串模块和计数器按照第二工作时序将所述寄存器存储的实时数据转换为待用芯片数据并输出至外部单片机，完成数据强制读取； 其中，所述数据更新具体包括： S11、所述半双工接口模块接收所述状态机发送的更新有效信号，所述更新有效信号为所述半双工接口模块没有接收到所述外部输入信号，且所述寄存器的数据存储状态表示存在待更新至外部单片机的目标数据时，所述状态机生成； S12、根据所述更新有效信号拉高端口线并持续第一时间； S13、接收外部单片机发送的反馈电平信号，所述反馈电平信号包括外部单片机拉低端口线第二时间产生的第一电平信号，以及在第二时间后拉高端口线第三时间的第二电平信号； S14、基于所述第二电平信号生成时钟信号，以使所述状态机检测到所述时钟信号时，将所述时钟信号发送至所述计数器，所述计数器开始计数，并将计数值发送到所述并转串模块，其中，所述并转串模块根据所述计数值将所述目标数据的最高有效位进行修改，以将所述目标数据转换为待用芯片数据，供所述所述半双工接口模块输出； S15、输出所述待用芯片数据N个系统时钟周期，在所述N个系统时钟周期中，外部单片机对所述待用芯片数据的最高有效位及最低有效位进行采样； S17、重复所述S13至S16，直至所述S14中，所述状态机检测到的所述时钟信号大于第四时间，并将所述半双工接口模块、并转串模块和计数器复位；其中，若N次重复所述S13至S16，则外部单片机获得N个待用芯片数据的最高有效位以及N待用芯片数据的最低有效位，完成数据更新； 其中，所述数据强制读取具体包括： S21、所述半双工接口模块根据强制读取指令屏蔽更新有效信号，同时根据所述预设类型的外部输入信号拉高端口线并持续第一时间；所述强制读取指令为所述半双工接口模块接收到所述外部输入信号，且所述外部输入信号为预设类型时，所述状态机生成； S22、接收外部单片机发送的反馈电平信号，所述反馈电平信号包括外部单片机拉低端口线第二时间产生的第一电平信号，以及在第二时间后拉高端口线第三时间的第二电平信号； S23、基于所述第二电平信号生成时钟信号，以使所述状态机检测到所述时钟信号时，将所述时钟信号发送至所述计数器，所述计数器开始计数，并将计数值发送到所述并转串模块；其中，所述并转串模块根据所述计数值将所述实时数据的最高有效位进行修改，以将所述实时数据转换为待用芯片数据，供所述所述半双工接口模块输出； S24、输出所述待用芯片数据N个系统时钟周期，在所述N个系统时钟周期中，外部单片机对所述待用芯片数据的最高有效位及最低有效位进行采样； S25、重复所述S22至S225，直至所述S23中，所述状态机检测到的所述时钟信号大于第四时间，并将所述半双工接口模块、并转串模块和计数器复位；其中，若N次重复所述S13至S16，则外部单片机获得N个待用芯片数据的最高有效位以及N待用芯片数据的最低有效位，完成数据强制读取。

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