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龙图腾网获悉南京湃睿半导体有限公司申请的专利基于差分延迟链的时间转换电路及芯片获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN117471895B 。

龙图腾网通过国家知识产权局官网在2026-04-07发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202311517976.1，技术领域涉及：G04F10/00；该发明授权基于差分延迟链的时间转换电路及芯片是由黄孙峰设计研发完成，并于2023-11-14向国家知识产权局提交的专利申请。

本基于差分延迟链的时间转换电路及芯片在说明书摘要公布了：本发明提供一种基于差分延迟链的时间转换电路及芯片。基于差分延迟链的时间转换电路包括：粗延迟链、第一延迟链、第一触发器链、高位编码计数器、第一低位编码器以及解码器。本发明的基于差分延迟链的时间转换电路及时间测量方法，采用差分延迟链系统架构，配合相应的内部测试与校准方法，时间测量精度得到大幅提升。

本发明授权基于差分延迟链的时间转换电路及芯片在权利要求书中公布了：1.一种基于差分延迟链的时间转换电路，其特征在于，包括： 粗延迟链，包括首尾串联的N个粗延迟单元，粗延迟链的起始端接收开始信号START，所述N个粗延迟单元用于将接收到的START信号进行N级第一延时τ1处理，其中，N为不小于2的整数； 第一延迟链，包括首尾串联的N个第一延迟单元，所述第一延迟链的起始端接收第一结束信号STOP1，N个第一延迟单元用于将接收到的STOP1进行N级第二延时τ2处理； 第一触发器链，包括N个第一触发器，所述N个第一触发器的第一输入端分别一一对应连接至N个粗延迟单元的输出端，N个第一触发器的第二输入端分别一一对应连接至N个第一延迟单元的输出端； 一数据选择器，所述数据选择器的输入分别连接至粗延迟链的第p级粗延迟单元以及第q级粗延迟单元的输出，所述数据选择器的输出反馈连接至粗延迟链的起始端Ring_In，形成一环形振荡器，其中p≠q； 高位编码计数器，高位编码计数器的输入连接至所述数据选择器的输出端，用于记录所述START信号在环形振荡器中的循环次数； 第一低位编码器，所述第一低位编码器的各输入端对应连接至所述第一触发器链的N个第一触发器的输出端； 解码器，所述解码器的输入连接至所述高位编码计数器和所述第一低位编码器的输出，将所述高位编码计数器和所述第一低位编码器输入的数据解码为时间计数； 其中，τ2＜τ1，且所述N个第一触发器的数据输入端分别一一对应连接至N个粗延迟单元的输出端，所述N个第一触发器的时钟端分别一一对应连接至N个第一延迟单元的输出端； 所述粗延迟链中第一级粗延迟单元是一个与非门，其余粗延迟单元是非门，且奇数级粗延迟单元的输出与上述各第一触发器的数据输入端之间通过一个非门对应连接，偶数级粗延迟单元的输出直接连接上述各第一触发器的数据输入端； 所述第一延迟链的N级第一延迟单元是非门，且奇数级第一延迟单元通过一个额外的非门连接至对应的第一触发器的时钟端，偶数级第一延迟单元的输出直接连接至对应的第一触发器的时钟端。

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