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龙图腾网获悉西安邮电大学申请的专利基于QC-LDPC硬判决译码算法的多路并行电路及其实现方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115632663B 。

龙图腾网通过国家知识产权局官网在2026-04-10发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211387225.8，技术领域涉及：H03M13/11；该发明授权基于QC-LDPC硬判决译码算法的多路并行电路及其实现方法是由张丽果;杜慧敏;曾泽沧;王心怡;白升飞;董怡设计研发完成，并于2022-11-07向国家知识产权局提交的专利申请。

本基于QC-LDPC硬判决译码算法的多路并行电路及其实现方法在说明书摘要公布了：本发明提供了一种基于QC‑LDPC硬判决译码算法的多路并行电路及其实现方法，用于解决现有基于硬判决GDBF算法的电路硬件资源消耗过大，且处理速度不能满足当前高速数据传输的技术问题。本发明的多路并行电路包括并行的P路硬判决电路、第一转换电路及第二转换电路；硬判决电路包括偏移模块、第一存储RAM、第二存储RAM、第二选择器、L个移位校验模块、计算模块、L+1个能量值存储RAM、翻转模块及第二异或模块；偏移模块用于存储选择校验矩阵的列偏移量和行偏移量；移位校验模块用于对码字进行移位并获得校验子之和；计算模块用于计算码字的能量值并对其进行编码、获得能量最大值；翻转模块用于根据码字每个比特位的能量值和能量最大值确定是否翻转。

本发明授权基于QC-LDPC硬判决译码算法的多路并行电路及其实现方法在权利要求书中公布了：1.一种基于QC-LDPC硬判决译码算法的多路并行电路，所述硬判决译码算法中设有二进制LDPC码的校验矩阵，其特征在于： 包括并行的P路硬判决电路、与P路硬判决电路输入端连接的第一转换电路3以及与P路硬判决电路输出端连接的第二转换电路4； 所述硬判决电路包括偏移模块、第一存储RAM5、第二存储RAM6、第二选择器8、L个移位校验模块、计算模块13、L+1个能量值存储RAM14、翻转模块15以及第二异或模块16；L的数量为校验矩阵的层数； 所述偏移模块用于存储和选择校验矩阵的列偏移量和行偏移量；移位校验模块，用于对码字进行移位并获得校验矩阵中每列值为1的位置上对应的校验子之和；计算模块13用于计算码字每个比特位的能量值并对全部能量值进行编码，进而获得能量最大值；所述编码的位数为L+1位，若其中有一个1，则第L+1位为1，其余位均为0，若其中有2个1，则第L位和第L+1位为1，其余位均为0，以此类推，若其中有L+1个1，则所有位为1；翻转模块15用于根据码字每个比特位的能量值和能量最大值比较结果确定是否翻转； 所述第一转换电路3输入端用于接收输入的初始码字信息并进行串并转换，其输出端分别连接P路硬判决电路中第一存储RAM5输入端，第一存储RAM5两个输出端分别连接第二选择器8一个输入端和第二异或模块16一个输入端；第二选择器8输出端和偏移模块输出端分别连接L个移位校验模块的输入端，L个移位校验模块输出端和第二异或模块16输出端分别连接计算模块13的L+1个输入端，计算模块13的一个输出端连接L+1个能量值存储RAM14输入端，其另一个输出端和能量值存储RAM14输出端均连接翻转模块15输入端，翻转模块15与第二存储RAM6互连，第二存储RAM6的第一输出端和第二输出端分别连接第二选择器8另一个输入端和第二异或模块16另一个输入端，用于将翻转后的码字信息和初始码字信息进行选择或异或；P路硬判决电路的第二存储RAM6的第三输出端并行连接第二转换电路4的输入端，用于将译码成功的码字信息通过第二转换电路4进行串并转换后输出。

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