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龙图腾网获悉芯梦达半导体科技(济南)有限公司申请的专利一种适用于多存储器测试系统的延迟器及延迟控制方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121306222B 。

龙图腾网通过国家知识产权局官网在2026-04-17发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511881312.2，技术领域涉及：G11C29/04；该发明授权一种适用于多存储器测试系统的延迟器及延迟控制方法是由濮必得;殷和国设计研发完成，并于2025-12-15向国家知识产权局提交的专利申请。

本一种适用于多存储器测试系统的延迟器及延迟控制方法在说明书摘要公布了：本发明公开了一种适用于多存储器测试系统的延迟器及延迟控制方法，涉及存储器测试技术领域，包括第一延迟寄存器和第二延迟寄存器；其中，第一延迟寄存器与多存储器测试系统中电子引脚的数据驱动器连接，用于根据第一延迟逻辑，调节数据驱动器对测试向量中若干数据信号的输出时序，以补偿若干待测存储器对应命令地址总线与数据总线之间的路径差异延迟；第二延迟寄存器与多存储器测试系统中电子引脚的数据接收器连接，用于根据第二延迟逻辑，调节数据接收器接收若干预期数据信号的时序，以补偿若干待测存储器的内部延迟。本发明可实现对测试向量中所有信号的延迟补偿，保障多存储器的有效测试，提高测试精度。

本发明授权一种适用于多存储器测试系统的延迟器及延迟控制方法在权利要求书中公布了：1.一种适用于多存储器测试系统的延迟器，其特征在于，所述延迟器包括第一延迟寄存器和第二延迟寄存器； 其中，第一延迟寄存器与多存储器测试系统中电子引脚的数据驱动器连接，用于根据第一延迟逻辑，调节数据驱动器对测试向量中若干数据信号的输出时序，以补偿若干待测存储器对应命令地址总线与数据总线之间的路径差异延迟； 第二延迟寄存器与多存储器测试系统中电子引脚的数据接收器连接，用于根据第二延迟逻辑，调节数据接收器接收若干预期数据信号的时序，以补偿若干待测存储器的内部延迟； 第一延迟寄存器根据第一延迟逻辑进行延迟调整，第一延迟逻辑为： 以距离最近的待测存储器对应命令地址总线与数据总线之间的路径延迟为基准DUT路径延迟，根据位于不同位置的其他若干待测存储器与最近待测存储器的命令地址总线物理路径距离，计算得到每一待测存储器的路径延迟； 基于每一待测存储器的路径延迟，调节对应待测存储器的数据信号的输出时间，使所有待测存储器同步接收数据信号，且数据信号与命令信号的接收时间匹配； 所述路径延迟与测试温度相关，公式为： ； 上式中，表示目标DUT的路径延迟，表示在标准温度下测量获取的基准DUT路径延迟，表示温度补偿系数，即单位温度变化引起的路径延迟变化率，表示当前温度与基准温度的差值，表示目标DUT与基准DUT的命令地址总线物理路径长度差异；表示基准温度下的信号传播速度，为光速，为介电常数； 在每一测试周期中，测试向量中面向若干不同位置处待测存储器的数据信号RR作为原始信号输入至比较器中，数据接收器输出的同步输出信号RO也输入至比较器中，通过比较器比较原始信号和输出信号RO，得到测试结果，并将该测试结果存储至测试向量中的设定比特位置； 第二延迟寄存器根据第二延迟逻辑进行延迟调整，第二延迟逻辑为： 获取不同待测存储器的内部延迟；所述内部延迟为CL值，CL值为接收命令到内存读取数据所需的时间； 基于每一待测存储器的内部延迟，调节对应待测存储器的预期数据信号接收时间，使所有待测存储器接收信号同步。

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