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龙图腾网获悉上海壁仞科技股份有限公司申请的专利用于高速接口知识产权核的内建自测试电路及方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121349789B 。

龙图腾网通过国家知识产权局官网在2026-05-05发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511918665.5，技术领域涉及：G06F11/26；该发明授权用于高速接口知识产权核的内建自测试电路及方法是由请求不公布姓名;请求不公布姓名设计研发完成，并于2025-12-18向国家知识产权局提交的专利申请。

本用于高速接口知识产权核的内建自测试电路及方法在说明书摘要公布了：本发明属于电子技术领域，提供了一种用于高速接口知识产权核的内建自测试电路及方法，该内建自测试电路包括：伪随机二进制序列生成器，用于生成对应码型数据；串行器，用于将码型数据转换为串行数据；信号收发单元；解串行器，用于对串行数据进行解串，得到解串数据和编码时钟信号；同步模块，用于根据编码时钟信号对解串数据进行延时补偿，并将延时补偿后的数据与伪随机二进制序列码型数据进行时间对齐，得到对齐后的数据对；比较器，用于对对齐后的数据对进行逻辑判决，并确定高速接口IP的内建自测试成功或失败。本发明所述内建自测试电路结构简单，不会额外占用凸点资源，提高了高速接口IP在BIST模式下的自测试效率和准确率。

本发明授权用于高速接口知识产权核的内建自测试电路及方法在权利要求书中公布了：1.一种用于高速接口知识产权核的内建自测试电路，其特征在于，包括： 伪随机二进制序列生成器，用于在内建自测试模式下，生成伪随机二进制序列，所述伪随机二进制序列为多位并行数据； 串行器，与所述伪随机二进制序列生成器连接，用于将所述伪随机二进制序列转换为串行数据； 信号收发单元，与所述串行器连接，用于转发所述串行数据； 解串行器，与所述信号收发单元连接，用于对所述串行数据进行解串，得到解串数据和编码时钟信号； 同步模块，与所述解串行器连接，用于根据所述编码时钟信号对所述解串数据进行延时补偿，并将延时补偿后的数据与所述伪随机二进制序列码型数据进行时间对齐，得到对齐后的数据对，所述对齐后的数据对包括对齐后的解串数据与对应的伪随机二进制序列码型数据； 所述同步模块包括延时选择控制电路；所述延时选择控制电路用于通过控制多路选择器微调接收数据的时序位置，以补偿物理链路带来的固定延时；所述多路选择器用于选中经过不同级数D触发器的路径； 比较器，与所述同步模块连接，用于对所述对齐后的数据对进行逻辑判决，得到多个逻辑判决结果，并通过所述多个逻辑判决结果确定高速接口知识产权核的内建自测试成功或失败。

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