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最新专利技术
  • 一种通信控制方法、控制系统及火箭
    一种通信控制方法、控制系统及火箭_北京天兵科技有限公司_202512060549.0
    本发明实施例提供一种通信控制方法、控制系统及火箭，该方法包括：提前设定每个指令对应的消息的基准周期包括：设置对所有消息进行查看的调度控制周期；基于指令的数量和调度控制周期设置每个指令对应的消息的基准周期，基于最大基准周期确定1553B总线的...
    2026-04-19
  • 一种自动翻译器
    一种自动翻译器_衢州学院_202310748813.8
    本发明提供了一种自动翻译器，涉及自动翻译技术领域，包括：处理器仓，所述处理器仓的顶部设置有三组插孔，处理器仓的底部设置有type‑c插扣；处理器仓内设置有蓄电源；数据线，所述数据线的数量设置为三组，三组数据线插接设置在处理器仓的顶部；设置分...
    2026-04-19
  • 一种硬件加速器及其集群
    一种硬件加速器及其集群_白盒子(上海)微电子科技有限公司_202511671898.X
    本发明涉及一种硬件加速器及其集群，其中，硬件加速器包括：主控单元和可编程逻辑单元；配置寄存器模块，用于完成主控单元和可编程逻辑单元的临时交互处理；可编程逻辑单元用于根据主控单元下发的计算任务输出控制指令；多个并行设置的计算处理单元，用于根据...
    2026-04-19
  • 低延时后发送
    低延时后发送_辉达公司_202511444037.8
    本公开涉及低延时后发送。本发明描述了一种系统，其具有一个或更多个处理设备，用于准备工作队列条目(WQE)、传输WQE或提供指示WQE可用的门铃指示，以及响应于确定执行失败已经发生，执行至少一个附加步骤以促进与WQE相关联的操作的完成。
    2026-04-19
  • 基于AXI总线的流量控制方法、设备、介质及产品
    基于AXI总线的流量控制方法、设备、介质及产品_太初(无锡)电子科技有限公司_202512009016.X
    本发明公开了一种基于AXI总线的流量控制方法、设备、介质及产品，该方法包括：在向多芯片系统中第一对端芯片连续发送写地址和写数据之前，获取匹配的第一数据量计算所需的第一信用值。查询本地维护的与第一对端芯片匹配的目标写操作计数器，判断当前信用值...
    2026-04-19
  • 一种异构操作系统主机间进程通信的封装方法及系统
    一种异构操作系统主机间进程通信的封装方法及系统_北京华迅通信技术有限公司_202610296614.1
    本申请提供一种异构操作系统主机间进程通信的封装方法及系统，涉及异构主机通信技术领域，本申请通过在源主机获取源进程包含目标进程标识、通信数据的通信请求，识别源主机与目标主机操作系统异构性，并确定对应含数据转换规范、进程标识映射规则的封装协议；...
    2026-04-19
  • 设备级混合操作系统快速交互方法
    设备级混合操作系统快速交互方法_广东新型储能国家研究院有限公司_202511918142.0
    本申请涉及一种设备级混合操作系统快速交互方法、装置、计算机设备、计算机可读存储介质和计算机程序产品，涉及操作系统领域，能够提高在多核处理系统中多核之间数据交互的安全性。方法包括：确定主核与子核之间基于共享内存的核间通信通道；响应于交互触发信...
    2026-04-19
  • 一种芯片系统、板卡和并行处理装置
    一种芯片系统、板卡和并行处理装置_北京行云集成电路有限公司_202511958323.6
    本申请实施例适用于计算机技术领域，提供了一种芯片系统、板卡和并行处理装置，芯片系统包括GPU主晶粒和至少一个IO扩展从晶粒；主晶粒第一接口单元与第一存储单元连接，从晶粒第三接口单元与主晶粒第二接口单元、从晶粒总线连接，第四接口单元分别与第二...
    2026-04-19
  • 计算机系统及数据处理方法
    计算机系统及数据处理方法_上海壁仞科技股份有限公司_202511882513.4
    本发明涉及计算机架构技术领域，提供了一种计算机系统及数据处理方法，该系统包括片上网络根据地址交错策略进行数据流量分发；数据链路模块包括多个数据链路单元，且每个数据链路单元包括多个数据链路；网络传输模块包括多个网络传输层，多个网络传输层与片上...
    2026-04-19
  • 一种数据采集方法、设备及介质
    一种数据采集方法、设备及介质_普源精电科技股份有限公司_202511902423.7
    本申请公开一种数据采集方法、设备及介质，涉及电子设备技术领域，用于解决在数据采集中存在同步精度较低的问题。该方法包括：主卡在确定自身的第一采样点的采样数据满足第一上报要求时，向从卡发送触发信号；触发信号用于指示从卡基于各自的采样时钟，停止数...
    2026-04-19
  • 一种面向硬件仿真加速系统的处理器间互连架构
    一种面向硬件仿真加速系统的处理器间互连架构_西安电子科技大学_202511922079.8
    本申请属于仿真加速技术领域。本申请提供一种面向硬件仿真加速系统的处理器间互连架构。本公开实施例提出一种分层互连网络架构，通过将大尺寸交叉开关分解为多个小尺寸多路复用器阵列的组合，划分成集群内网络、布尔处理器集群间网络、TDM接口集群互连网络...
    2026-04-19
  • 多块数字存内计算(DIMC)神经处理单元(NPU)中的共享路由和感测
    多块数字存内计算(DIMC)神经处理单元(NPU)中的共享路由和感测_意法半导体国际公司_202511412650.1
    本公开涉及多块数字存内计算(DIMC)神经处理单元(NPU)中的共享路由和感测。第一存储器内计算(IMC)电路包括被耦合用于与第一接口电路的数据通信的第一IMC处理块。第二IMC电路包括被耦合用于与第二接口电路的数据通信的第二IMC处理块。...
    2026-04-19
  • 嵌入ReLU和池化操作的输出电路及控制方法
    嵌入ReLU和池化操作的输出电路及控制方法_杭州市北京航空航天大学国际创新研究院(北京航空航天大学国际创新学院)_202511689950.4
    一种嵌入ReLU和池化操作的输出电路及控制方法，适用于存内计算架构，所述输出电路包括：存内计算乘法电路、逐次逼近模数转换器和多模式控制电路；存内计算乘法电路，输出模拟计算信号；逐次逼近模数转换器与所述存内计算乘法电路相连，对计算信号执行电荷...
    2026-04-19
  • 一种用于感知算法的融合式加速器及其执行方法
    一种用于感知算法的融合式加速器及其执行方法_清华大学_202511745029.7
    本发明提供一种用于感知算法的融合式加速器及其执行方法，涉及计算机技术领域，所述融合式加速器包括：顶层控制器，用于获取中央处理单元发送指令；片上存储单元，用于存储融合式加速器待处理数据；可重构计算阵列，用于分别获取顶层控制器的指令和片上存储单...
    2026-04-19
  • 一种具有可重构硬件逻辑引擎的模块化同步触发方法及系统
    一种具有可重构硬件逻辑引擎的模块化同步触发方法及系统_广东省中医院(广州中医药大学第二附属医院、广州中医药大学第二临床医学院、广东省中医药科学院)_202511804284.4
    本发明提供一种具有可重构硬件逻辑引擎的模块化同步触发方法及系统，应用于数据采集与设备控制领域，该方法包括：管理处理器接收事件触发逻辑生成硬件配置参数，配置可重构硬件执行器内事件逻辑执行引擎，引擎实时并行监测多模态输入信号，硬件层面比对判断产...
    2026-04-19
  • 掩膜矩阵向量乘法的存内计算方法及装置
    掩膜矩阵向量乘法的存内计算方法及装置_北京大学_202511833147.3
    本公开涉及一种掩膜矩阵向量乘法的存内计算方法及装置，通过将掩膜元素与权重参数元素分别存储于每个存算单元内部的易失性存储节点与非易失性存储器中，以使存储阵列中的每个存算单元是否参与计算，可由其存储的掩膜元素独立控制，掩膜的最小粒度为单个存算单...
    2026-04-19
  • 存内计算单元及其操作方法、存内计算阵列
    存内计算单元及其操作方法、存内计算阵列_北京大学_202511834503.3
    本申请涉及一种存内计算单元及其操作方法、存内计算阵列，存内计算单元包括：写晶体管、读晶体管以及非易失性存储器；写晶体管的第一极与读晶体管的栅极连接，共同构成存储节点，写晶体管的第二极连接至写位线，栅极连接至写字线；读晶体管的第一极连接至读字...
    2026-04-19
  • 可配置存算芯粒、芯粒系统及芯粒系统的控制方法
    可配置存算芯粒、芯粒系统及芯粒系统的控制方法_之江实验室_202511850482.4
    本申请涉及一种可配置存算芯粒、芯粒系统及芯粒系统的控制方法，该可配置存算芯粒包括第一输入接口、第二输入接口、存算阵列、第一输出接口、第二输出接口和配置模块。第一输入接口用于接收第一输入数据；第二输入接口用于在开启时接收第二输入数据；存算阵列...
    2026-04-19
  • 一种量子精密测量用的通用控制板卡
    一种量子精密测量用的通用控制板卡_华中光电技术研究所(中国船舶集团有限公司第七一七研究所)_202512009366.6
    本发明公开了一种量子精密测量用的通用控制板卡，由FPGA核心单元以及与FPGA核心单元连接的背板连接器、电源管理单元、通信单元、接口单元及指示灯连接组成，FPGA核心单元包括FPGA主芯片，FPGA主芯片上分别连接有用于提供时钟的晶振、用于...
    2026-04-19
  • 一种基于Transformer模型推理的ReRAM写延迟消除方法与系统
    一种基于Transformer模型推理的ReRAM写延迟消除方法与系统_浙江大学_202512041694.4
    本发明提供了一种基于Transformer模型推理的ReRAM写延迟消除方法与系统，本发明基于ReRAM的存算一体架构系统，分析Transformer模型中KV增量生成的特征与ReRAM写KV之间的关系，提出延迟写KV的思想，以消除推理关键...
    2026-04-19
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