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基于ROCEv2的高带宽低延迟数据处理方法
本发明公开了一种基于ROCEv2的高带宽低延迟数据处理方法, 涉及数据处理技术领域, 基于ROCEv2协议实现, 包括主机服务器和芯片, 所述主机服务器对每个队列对均包括一个系统内存和虚拟地址的映射表, 所述芯片包括ROCEv2协议处理接口...
一种零拷贝数据传输方法、设备、介质及产品
本发明公开了一种零拷贝数据传输方法、设备、介质及产品, 属于数据传输技术领域, 方法包括:应用程序向内核模块请求内存缓冲区;内核模块根据请求分配一个物理内存缓冲区, 并返回特殊设计的描述符(含地址指针对应的句柄);应用程序向内核模块提交描述...
一种基于行列组合扩展汉明码纠错的星载图像存储系统
本发明公开了一种基于行列组合扩展汉明码纠错的星载图像存储系统, 包括:电源模块, 用于为星载图像存储系统提供稳定的所需电压;主控模块, 通过DMA控制器实现数据实时传输到存储阵列模块, 并内置行列组合扩展汉明码, 对待存储的数据进行校验及纠...
中断控制电路、方法、芯片及电子设备
本申请提供一种中断控制电路、方法、芯片及电子设备。在同一时刻发生中断事件时, 多个子模块生成各自中断事件对应的中断请求, 并向仲裁器发送中断请求和中断优先级。仲裁器根据多个中断优先级和多个中断请求, 得到仲裁结果, 并向中断处理器发送仲裁结...
数据读写方法、系统、设备及存储介质
本申请涉及数据处理领域, 提供了一种数据读写方法、系统、设备及存储介质, 方法包括:获取数据读写指令的读写类型;当所述读写类型为读类型时, 获取针对所述数据读写指令的仲裁方式;基于所述仲裁方式, 确定读指针的目标指针位置;所述目标指针位置表...
芯片和内存管理方法
本申请提供一种芯片和内存管理方法。芯片包括:内存、寄存器、以及多个CAN控制器。内存包括多个报文存储区。所述多个报文存储区和所述多个CAN控制器对应, 每个所述报文存储区包括多个存储区间, 每个所述存储区间用于存储一个报文, 所述CAN控制...
基于FPGA的DDR4多通道数据仲裁传输方法、系统、设备及介质
本发明公开了一种基于FPGA的DDR4多通道数据仲裁传输方法, 包括:S1、设计多通道架构, 形成N个数据传输通道, 所述N个数据传输通道相互独立;S2、设置缓存区;S3、AD采样与缓存;S4、通过写仲裁逻辑向DDR4中写入数据, 寻找采样...
基于SPI设备树的PLC设备自适应方法
本发明涉及PLC设备驱动加载技术领域, 为解决多个PLC设备驱动加载时流程繁琐, 且不利于设备树的修改和更新的技术问题, 公开一种基于SPI设备树的PLC设备自适应方法, PLC设备为N个, 所述方法包括以下步骤:将SPI控制器节点中cs‑...
接口切换方法、装置、设备、介质及产品
本申请提供了一种接口切换方法、装置、设备、介质及产品。其中, 接口切换方法应用于终端设备, 终端设备上设置有至少两个通用串行总线USB接口, 接口切换方法包括:响应于第一USB接口检测到调试设备, 获取调试设备的信息, 信息包含通信协议;响...
缓存行替换方法、装置、芯片及电子设备
本公开涉及人工智能芯片和存储管理技术领域, 具体涉及一种缓存行替换方法、装置、芯片及电子设备。该方法应用于含数据缓存的芯片, 数据缓存包含已存储数据的N个缓存行, 基于PLRU算法中包含N‑1个节点的二叉树结构对每个缓存行对应访问路径进行管...
一种缓存管理方法、装置、设备、介质及计算机程序产品
本申请实施例提供了一种缓存管理方法、装置、设备、介质及计算机程序产品, 该方法包括:当数据项第一次被访问时, 将所述数据项加载到访问历史队列;当所述数据项在访问历史队列中被访问次数大于等于阈值K时, 将所述数据项加载到缓存队列中。本申请实施...
使用共享指针的间接存储器存取
本申请涉及使用共享指针的间接存储器存取。本文中描述用于间接存取存储器中的对象的系统及技术。接收针对对象的存储器分配请求, 所述存储器分配请求指定共享指针的使用。识别用以履行这种分配的存储器地址且将指向这个地址的指针写入能够由主机及存储器装置...
一种内存访问方法、设备、存储介质及程序产品
本申请公开了一种内存访问方法、设备、存储介质及程序产品, 涉及内存访问技术领域, 包括:监测目标内存的内存访问信息;内存访问信息包括内存访问时的缺页地址序列、地址转换后备缓冲器出现地址转换失败事件时的地址分布特征、跨节点访问事件和虚拟内存访...
一种虚拟地址转换方法、设备、介质及产品
本申请公开了一种虚拟地址转换方法、设备、介质及产品, 涉及内存管理技术领域, 包括在对目标数据中的页面进行分配时, 将目标数据中的各虚拟页面分配至不同加速器中物理帧号相同的物理页面, 从而形成至少一个合并组, 后续当获取到针对目标虚拟页面的...
阶层式存储器系统中的存储器管线控制
本发明实施例涉及阶层式存储器系统中的存储器管线控制。在所描述的实例中, 一种处理器系统包含产生存储器事务的处理器核心、具有较低存储器控制器的较低级别高速缓存存储器及具有带有存储器管线的较高存储器控制器的较高级别高速缓存存储器。较高存储器控制...
请求处理方法、二级合并装置、及请求处理系统
本公开实施例公开了一种请求处理方法、二级合并装置、及请求处理系统, 其中, 该请求处理方法包括:对待处理指令的多个原始请求进行一级合并, 得到多个一级合并请求;对多个一级合并请求进行二级合并, 得到多个二级合并请求, 并将二级合并请求下发至...
接口缓冲装置、集成电路通信系统和方法
本发明公开了一种接口缓冲装置、集成电路通信系统和方法。其中, 该接口缓冲设备包括:上行接口, 与主设备通信;多个集成电路I2C主接口, 分别与对应的多个从设备的I2C从接口通信;控制单元, 用于对上行接口和多个I2C主接口进行控制, 并对从...
一种数据缓存装置、集成电路及电子设备
本申请公开了一种数据缓存装置、集成电路及电子设备, 其装置包括:数据块地址模块, 被配置为解析指令调度阶段的运算指令, 得到运算类型以及运算数据所在内存装置的第一数据地址;根据第一数据地址和运算指令所需的时钟周期, 生成第一数据块地址及组起...
数据处理方法、装置、设备、存储介质及程序产品
本申请实施例提供一种数据处理方法、装置、设备、存储介质及程序产品。包括:判断应用层针对待写数据写请求的传输模式是否为直接读写模式;若不为直接读写模式, 则继续判断是否启用了客户端缓存机制;若启用了客户端缓存机制, 则继续判断待写数据或待写数...
人工智能芯片的缓存及其操作方法
本公开提供一种人工智能芯片的缓存及其操作方法, 以高效执行对缓存的管理操作命令。缓存包括命令表以及命中‑未命中检查单元。命中‑未命中检查单元耦接于命令表。响应于多个计算核中的一者将管理操作命令发送给缓存, 命中‑未命中检查单元将管理操作命令...
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